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FIR设计 的查询结果
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VHDL/FPGA/Verilog 65位FIR数字滤波器的设计~~其中有通过仿真得出得数据 ~可以通过数据输入完成滤波实验~对数字滤波器得整个算法进行了分析包括输入分组相加 然后相乘得过程
65位FIR数字滤波器的设计~~其中有通过仿真得出得数据 ~可以通过数据输入完成滤波实验~对数字滤波器得整个算法进行了分析包括输入分组相加 然后相乘得过程
人工智能/神经网络 给出了FIR滤波器设计的C语言程序
给出了FIR滤波器设计的C语言程序，可以根据设计要求，灵活地调整参数，得到需要的滤波器参数。
DSP编程 在c54xx的平台上实现fir滤波器的dsp课程设计主程序
在c54xx的平台上实现fir滤波器的dsp课程设计主程序
VHDL/FPGA/Verilog 用vhdl实现一个fir滤波器 设计要求： 1．最小阻带衰减-30db。 2．带内波动小于1db． 3．用MATLIB与MAXPLUS2联合设计与仿真
用vhdl实现一个fir滤波器
设计要求：
1．最小阻带衰减-30db。
2．带内波动小于1db．
3．用MATLIB与MAXPLUS2联合设计与仿真
matlab例程 本程序是关于FIR和IIR滤波器的设计现
本程序是关于FIR和IIR滤波器的设计现
DSP编程 数字滤波的设计:FIR滤波器,设计滤波器采样频率为600hz
数字滤波的设计:FIR滤波器,设计滤波器采样频率为600hz，截止频率200hz的高通滤波器
VHDL/FPGA/Verilog 常系数的FIR滤波器VHDL设计文件
常系数的FIR滤波器VHDL设计文件，在MUX+plusII调试通过
matlab例程 分别用窗函数法和等波纹最佳一致逼近法分别对FIR数字滤波器进行设计和仿真
分别用窗函数法和等波纹最佳一致逼近法分别对FIR数字滤波器进行设计和仿真，并通过具体实例进行实现
VHDL/FPGA/Verilog 设计一个线性相位FIR滤波器（31阶） 输入8位
设计一个线性相位FIR滤波器（31阶）
输入8位，输出8位,H(n)={1,2,0,-2,-2,1,6,6,-1,-13,-21,-11,22,69,111,128,111,……2,1}
H(n)具有对称性。
输入信号范围
[±99，0，0，0， ±70，0，0，0， ±99，0，0，0， ±70，…]
matlab例程 频率采样法设计fir滤波器
频率采样法设计fir滤波器，大家可以看看。
挺不错的。