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FIFO 的查询结果
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中间件编程 xilinx公司的开放的源码
xilinx公司的开放的源码，很有参考价值，其中有ddl，fifo控制等。
嵌入式Linux 工ARM＿LINUX的几个源代码
工ARM＿LINUX的几个源代码，fork,pipe,fifo,及共享内存的实验源程序
单片机开发 在AVR单片机上使用的一款RTOS
在AVR单片机上使用的一款RTOS，可抢占内核，FIFO等功能
技术资料 Verilog sd卡 IP核
使用Verilog进行开发的IP核，包括了FIFO以及与sd卡进行交互的模块
技术资料 简单sdram控制verilog源码
简单的sdram操作，采用状态机实现，加入FIFO进行异步时钟数据传输
Linux/Unix编程 操作系统实验：模拟LINUX操作系统的虚存管理机制
操作系统实验：模拟LINUX操作系统的虚存管理机制，采用多道程序控制方式、多级页表、FIFO请求方式完成对实存辅存的映射管理，处理访存请求。实现了FIFO、LRU、LFU等页表淘汰算法。
VHDL/FPGA/Verilog 8位深
8位深，9位宽FIFO VHDL源码设计，如需改进可在此基础上扩展
嵌入式Linux 此程序为串口芯片tl16c750在uClinux + s3c44b0环境下的驱动程序.tl16c750R FIFO设置为64BYTES, 除此之外,此程序还能缓存20条已经收到的串口数据.即存储数据量
此程序为串口芯片tl16c750在uClinux + s3c44b0环境下的驱动程序.tl16c750R FIFO设置为64BYTES, 除此之外,此程序还能缓存20条已经收到的串口数据.即存储数据量为20*64=1280BYTES的串口数据,而不用担心未及时读串口时发生数据的丢失现象.此外,附此驱动的测试程序,以及编译后的映像文件. ...
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IP核生成器生成 ip 后有两个文件对我们比较有用，假设生成了一个 asyn_fifo 的核，则
asyn_fifo.veo 给出了例化该核方式（或者在 Edit－>Language Template->COREGEN 中找到
verilog/VHDL 的例化方式）。asyn_fifo.v 是该核的行为模型，主要调用了 xilinx 行为模型库
的模块，仿真时该文件也要加入工程。 ...