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FIFO 的查询结果
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技术资料 XC4000系列的Select-RAM(TM)可配置成边沿触发RAM和双口RAM,边沿触发简化系统定时,双口RAM简化FIFO的设计
The XC4000E and XC4000EX FPGA families provide distributed on-chip RAM. Select-RAMTM memory can be c
操作系统开发 页面置换算法 设计一个虚拟存储区和内存工作区,编程序演示FIFO、LRU、OPT算法的具体实现过程,并计算访问命中率.
页面置换算法
设计一个虚拟存储区和内存工作区,编程序演示FIFO、LRU、OPT算法的具体实现过程,并计算访问命中率.
VHDL/FPGA/Verilog 256字节深度的RS232串口程序,共分4个模块,顶层文件FIFO程序串口收和串口发.经过测试已用于产品.可靠!
256字节深度的RS232串口程序,共分4个模块,顶层文件\FIFO程序\串口收和串口发.经过测试已用于产品.可靠!
电子书籍 请求页式存储管理 操作系统课程设计 设计一个请求页式存储管理方案。并编写模拟程序实现之。页面淘汰算法采用 FIFO页面淘汰算法
请求页式存储管理 操作系统课程设计
设计一个请求页式存储管理方案。并编写模拟程序实现之。页面淘汰算法采用 FIFO页面淘汰算法,并且在淘汰一页时,只将该页在页表中抹去。而不再判断它是否被改写过,也不将它写回到辅存 ...
Linux/Unix编程 入门程序
入门程序,用于测试fifo。 仅仅几行,但可以了解fifo基本写法
DSP编程 VC5416 对USB寄存器的读/写、配置; VC5416 对 USB的 FIFO 的操作; VC5416 对 USB的 setup 包的操作; VC5416 对 USB的 Endpointo
VC5416 对USB寄存器的读/写、配置;
VC5416 对 USB的 FIFO 的操作;
VC5416 对 USB的 setup 包的操作;
VC5416 对 USB的 Endpointo 的操作;
VHDL/FPGA/Verilog RS(204,188)译码器的设计 异步FIFO设计 伪随即序列应用设计 CORDIC数字计算机的设计 CIC的设计 除法器的设计 加罗华域的乘法器设计
RS(204,188)译码器的设计
异步FIFO设计
伪随即序列应用设计
CORDIC数字计算机的设计
CIC的设计
除法器的设计
加罗华域的乘法器设计
微处理器开发 SSI对从外设器件接收到的数据执行串行到并行转换。CPU可以访问SSI数据寄存器来发送和获得数据。发送和接收路径利用内部FIFO存储单元进行缓冲
SSI对从外设器件接收到的数据执行串行到并行转换。CPU可以访问SSI数据寄存器来发送和获得数据。发送和接收路径利用内部FIFO存储单元进行缓冲,以允许最多8个16位的值在发送和接收模式中独立地存储。
使用 ssi 控制1位数码管的显示 ...
操作系统开发 超值奉献
超值奉献,Clifford E. Cummings FIFO关于异步FIFO的两篇文章,同时附有中文解说,主要讲解异步FIFO的实现难点---空满标志的产生,以及读写地址的产生