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可编程逻辑 Nios II定制指令用户指南

     Nios II定制指令用户指南:With the Altera Nios II embedded processor, you as the system designer can accelerate time-critical software algorithms by adding custom instructions to the Nios II processor instruction set. Using custom instructions, you can reduce a complex sequen ...
https://www.eeworm.com/dl/kbcluoji/39394.html
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可编程逻辑 基于Xilinx公司的SOPC的以太网设计

  1.设计(论文)的主要任务及目标   (1) 研究SOPC理论如何应用于以太网终端设计;   (2) 研究如何使用EDK软件和IP核搭建整个设计硬件结构;   (3) 在开发板上实现以太网终端设计,验证整个结论。   2.设计(论文)的基本要求和内容   (1) 符合以太网设计的基本概念和原理;   (2) ...
https://www.eeworm.com/dl/kbcluoji/39483.html
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可编程逻辑 用于Xilinx和Altera FPGA的电源管理解决方案

    本资料是TI(德州仪器)推出的用于Xilinx和Altera FPGA的电源管理解决方案介绍。其主要内容包括:低失真调整器、步减控制器、集成FET转换器、低功率集成FET转换器等。
https://www.eeworm.com/dl/kbcluoji/39647.html
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可编程逻辑 物联网智能交通拥堵判别算法的研究与实现

    针对城市道路交叉口的常发性交通拥堵现象,依据RFID检测系统的特点,提出了一种基于物联网前端信息采集技术的交通流检测方法。并且对城市道路交叉口采集到的交通流量相对增量、车辆的时间占有率相对增量以及地点平均车速等信息进行了对比性分析和统计推导,从理论上论证了交通拥挤产生时的交通流特点, ...
https://www.eeworm.com/dl/kbcluoji/39835.html
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可编程逻辑 基于LPC2138的AES3数字音频接口设计

     随着数字音频技术的不断发展,数字化音频设备已广泛应用于广播电视节目领域。鉴于专业数字音频设备越来越多地需求,以及专用接收发送设备的复杂性,本设计采用Philips公司的ARM7控制芯片LPC2138结合音响设备专用芯片,设计一个简单的AES/EBU(AES3)数字音频收发系统,实现了专业AES3数字音频的 ...
https://www.eeworm.com/dl/kbcluoji/39848.html
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工控技术 赛灵思(xilinx)工业自动化解决方案概述(英文版)

  xilinx设计可以快速适应各种发展标准和处理要求,从而可以改进分析能力来满足市场需求,同时可以在最初部署后的很长一段时间内添加各种特性和功能。   Xilinx All Programmable FPGA 和基于 SoC 的解决方案和平台可充分满足当今磁场定向控制 (FOC) 等复杂控制算法所提出的苛刻的时序和性能要求。   Xilinx ...
https://www.eeworm.com/dl/569/40869.html
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测试测量 基于海天线提取的红外小目标检测方法

通过对海上红外图像进行分析,提出了一种基于海天线提取的红外小目标检测方法。该算法的基本思路是根据所需提取目标的特点,首先选择感兴趣的灰度区域,然后运用Canny算子进行边缘检测,接着对图像进行Hough变换检测海天线,最后对海天线以下且符合目标特征的连通域进行标记从而来确定目标的位置。实验结果表明,该方法能较 ...
https://www.eeworm.com/dl/544/41788.html
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测试测量 基于多表的动态查询模块设计与实现

查询是信息管理系统中使用涉及用户最多使用最频繁的功能。为了提高用户查询的灵活性与查询效率,设计了基于多表的动态查询模块,使得用户可以自己选择查询数据项,动态组合查询条件。应用结果表明,该模块不仅提高了查询的灵活度与效率,而且增加了查询的信息量,用户的满意度达到了98% 以上。 ...
https://www.eeworm.com/dl/544/41808.html
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仿真技术 如何仿真IP核(建立modelsim仿真库完整解析)

  IP核生成文件:(Xilinx/Altera 同)   IP核生成器生成 ip 后有两个文件对我们比较有用,假设生成了一个 asyn_fifo 的核,则asyn_fifo.veo 给出了例化该核方式(或者在 Edit-》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式)。asyn_fifo.v 是该核的行为模型,主要调用了 xilinx 行为模型库的模块 ...
https://www.eeworm.com/dl/524/42501.html
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技术资料 Cadence学习笔记--原理图

cadence学习笔记1__原理图打开Design Entry CIS或OrCAD Capture CIS组件,选择OrCAD Capture CIS(不要选择OrCAD Capture,因为少了一些东西),如果勾选了左下角的“Use as default”复选框,下次就不用选择了,如果要使用其他的部分,就在打开后点击FileàChange Product,会弹出一个“Cadence Product Choices”窗口:Fi ...
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