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分析了MATLAB/Simulink 中DSP Builder 模块库在FPGA 设计中优点，然后结合FSK 信号的产生原理，给出了如何利用DSP Builder 模块库建立FSK 信号发生器模型，以及对FSK 信号发生器模型进行算法级仿真和生成VHDL 语言的方法，并在modelsim 中对FSK 信号发生器进行RTL 级仿真，最后介绍了在FPGA 芯片中实现FSK 信号发生器的设 ...

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Simulink Builder MATLAB FPGA

VHDL/FPGA/Verilog VHDL源码其中“music_rom”使用FPGA厂商提供的工具生成的

VHDL源码其中“music_rom”使用FPGA厂商提供的工具生成的，如Altera的Quartus II 及其宏功能生成的这些文件。另外，我们还希望实现以下功能： * 播放音乐时，在ROM的结尾处暂停 * "fullnote"值为0时，表示静音所以我们将原来的程序的最后一行从 ...

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music_rom VHDL FPGA 源码

VHDL/FPGA/Verilog 高级FPGA 教学实验平台实验指导书－嵌入式系统设计

高级FPGA 教学实验平台实验指导书－嵌入式系统设计

https://www.eeworm.com/dl/663/325844.html

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FPGA 教学实验实验指导书嵌入式系统设计

VHDL/FPGA/Verilog 一些FPGA接口电路的例子很有用的大家看看啊

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https://www.eeworm.com/dl/663/328761.html

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FPGA 接口电路家

VHDL/FPGA/Verilog 应用分布式算法在FPGA平台实现FIR低通滤波器

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https://www.eeworm.com/dl/663/331730.html

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FPGA FIR 分布式算法低通滤波器

VHDL/FPGA/Verilog Altera公司开发的用于其FPGA的的Nios软核入门介绍

Altera公司开发的用于其FPGA的的Nios软核入门介绍

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Altera FPGA Nios 软核

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