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技术资料 FPGA动态自重构系统的设计方法学
当前主流计算模式是处理器模式和ASIC模式，处理器计算模式虽然能够灵活地实现各种计算任务，但是性能上有不足，ASIC模式虽然性能较高，却不能够灵活地应对计算任务的改变。在这种情况下，FPGA的可重构特性以及高效的并行执行... ...
VHDL/FPGA/Verilog VHDL语言100例详解
VHDL语言100例详解，北京理工大学ASIC研究生出版，这里是51~94个examples
技术资料 FPGA 专用集成电路设计
该书详细的介绍了ASIC 设计的基本概念和原理，适合专门从事集成电路设计人员
VHDL/FPGA/Verilog VHDL语言100例详解
VHDL语言100例详解，北京理工大学ASIC研究生出版，这里是1-20个examples
VHDL/FPGA/Verilog VHDL语言100例详解
VHDL语言100例详解，北京理工大学ASIC研究生出版，这里是21-50个examples
技术资料 ISE_WEBPACK_9[1].1i设计套件
FPGA_ASIC-赛灵思推出系统性能最高编译时间最快的ISE_WEBPACK_9[1].1i设计套件
ALTERA FPGA开发软件 Synplify.Pro.v7.6.rar
Synplify Pro是一个高级综合工具。其高级综合能力可以使你看到HDL代码在各种器件（FPGA/Structed ASIC/cell-based ASIC）上实现结果而无须对代码作任何修改。从而选择最合适的方式来实现它，或选择最合适的供应商。最主要的功能还是FPGA综合。 ...
技术资料 Synplify.Pro.v7.6.rar
Synplify Pro是一个高级综合工具。其高级综合能力可以使你看到HDL代码在各种器件（FPGA/Structed ASIC/cell-based ASIC）上实现结果而无须对代码作任何修改。从而选择最合适的方式来实现它，或选择最合适的供应商。最主要的功能还是FPGA综合。 ...
精品软件 SYNPLIFY.PRO.V7.6.RAR
Synplify Pro是一个高级综合工具。其高级综合能力可以使你看到HDL代码在各种器件（FPGA/Structed ASIC/cell-based ASIC）上实现结果而无须对代码作任何修改。从而选择最合适的方式来实现它，或选择最合适的供应商。最主要的功能还是FPGA综合。 ...
技术资料 cadence入门教程
cadence入门教程，asic开发，必备工具书，包含实例，书中一步一步讲解，堪称cadence icXXX经典教程。