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技术资料  EP2C5T144的核心例程

适用于Altera EP2C5T144的SRAM访问核心例程，经过多个项目验证，可直接用于生产环境。提供稳定可靠的FPGA开发参考，涵盖底层寄存器操作与数据读写逻辑。

https://www.eeworm.com/dl/1004017.html

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其他文档  基于Verilog HDL语言的FPGA设计

采用 Verilog HDL 语言在Altera 公司的FPGA 芯片上实现了RISC_CPU 的关键部件状态控制器的设计,以及在与其它各种数字逻辑设计方法的比较下,显示出使用Verilog

https://www.eeworm.com/dl/536/10863.html

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Verilog FPGA HDL 语言

学术论文  基于Verilog HDL设计的多功能数字钟

本文利用Verilog HDL 语言自顶向下的设计方法设计多功能数字钟，突出了其作为硬件描述语言的良好的可读性、可移植性和易理解等优点，并通过Altera QuartusⅡ 4.1 和ModelSim

https://www.eeworm.com/dl/514/13453.html

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Verilog HDL 多功能数字

嵌入式/单片机编程  嵌入式可编程器件CPLD的典型实例压缩包

嵌入式可编程器件CPLD的典型实例压缩包，共计43个源码文件。使用ALTERA的 Muxplus 软件即可编辑仿真相关软件可在教育网ftp下载[天网查询，有很多站点提供]

https://www.eeworm.com/dl/647/104415.html

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CPLD 嵌入式可编程器件典型

技术资料  Cyclone IV 系列官方手册 490页pdf高清完整版

cyclone4系列官方手册和数据手册，因为是外网，有可能被屏蔽，所以存个备份，大家有需要的可以一起学习。This handbook provides comprehensive information about the Altera® Cyclone® IV family of devices.

https://www.eeworm.com/dl/844831.html

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cycloneIV 官方手册数据手册

技术资料  基于Verilog HDL语言的FPGA设计

采用 Verilog HDL 语言在Altera 公司的FPGA 芯片上实现了RISC_CPU 的关键部件状态控制器的设计,以及在与其它各种数字逻辑设计方法的比较下,显示出使用Verilog

https://www.eeworm.com/dl/886639.html

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Verilog FPGA

技术资料  基于Nios平台的光信号采集片上系统设计

介绍基于Altera Excalibur 平台的光信号采集片上系统的设计，详细地分析片上系统各个组成部分的工作原理。作为一个新型的测量系统，它具有灵活、稳定、高效率等特点。

https://www.eeworm.com/dl/923167.html

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Nios 光信号

技术资料  基于Verilog HDL设计的多功能数字钟

本文利用Verilog HDL 语言自顶向下的设计方法设计多功能数字钟，突出了其作为硬件描述语言的良好的可读性、可移植性和易理解等优点，并通过Altera QuartusⅡ 4.1 和ModelSim

https://www.eeworm.com/dl/927562.html

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Verilog

技术资料  SDRAM控制器中引文对照

SDR SDRAM控制器提供了一个符合工业标准的SDR SDRAM的简单接口，该控制器可以使用Verilog HDL 或者VHDL语言来实现，同时针对Altera的APEX构架进行了优化

https://www.eeworm.com/dl/964934.html

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SDRAM 控制器对照

ALTERA FPGA开发软件  NIOSII IDE_5_00

"Nios II软件构建工具开发环境是一组功能强大的命令、工具以及脚本，利用它们可以管理应用程序、电路板支持包(BSP)和软件库的编译选项。命令在Nios II软件构建工具上可以独立于Nios II IDE而运行。如果你偏爱于使用命令行环境，或者你想获得能够快速适应你所喜欢的软件(或系统)开发环境的开发工具，Altera公司建议使用这个 ...

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NIOSII IDE 00

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