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8位机 的查询结果
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VHDL/FPGA/Verilog 拨码开关实验 拨码开关8 位0 1 状态在8 位7 段数码管相应位上显示0 或1。
拨码开关实验
拨码开关8 位0 1 状态在8 位7 段数码管相应位上显示0 或1。
VHDL/FPGA/Verilog 8位密码锁的实现
8位密码锁的实现，初始状态默认为密码正确，密码输入正确方可设密码，以后必须按对密码才可重设
微处理器开发 LRC校验函数说明及程序源码, 错误校验用于 ASCII 模式。这个错误校验码是一个 8 位二进制数
LRC校验函数说明及程序源码, 错误校验用于 ASCII 模式。这个错误校验码是一个 8 位二进制数，可作为 2 个
ASCII 十六进制字节传送。计算 LRC 码时，仅设备地址、功能代码、数据块字节参加
单片机开发 在单片机教学实验仪的MCU#3上的8位数码管上显示一个只有分和秒的时钟
在单片机教学实验仪的MCU#3上的8位数码管上显示一个只有分和秒的时钟，采用中断方式
VHDL/FPGA/Verilog 8位的加法器设计
8位的加法器设计，分4个工程完成的，用的是Quartus II软件。
嵌入式/单片机编程 利用软件编写的I2C传输界面程序,适用于现有4位机等汇编语言中!
利用软件编写的I2C传输界面程序,适用于现有4位机等汇编语言中!
单片机开发 此license为MOTORALA 8位单片机的编程环境 metrowks codewarriode的永久解码license for all-valid metrowks codewarriode
此license为MOTORALA 8位单片机的编程环境
metrowks codewarriode的永久解码license for all-valid metrowks codewarriode
和
文章/文档 EMC四位机开发工具及例程PPT格式（下）
EMC四位机开发工具及例程PPT格式（下）
VHDL/FPGA/Verilog 设计一个字节（8 位）比较器。 要求：比较两个字节的大小
设计一个字节（8 位）比较器。
要求：比较两个字节的大小，如a[7:0]大于 b[7:0]输出高电平,否则输出低电平,改写测试
模型,使其能进行比较全面的测试 。
VHDL/FPGA/Verilog 这是我自己写的两个8位二进制数的乘法程序
这是我自己写的两个8位二进制数的乘法程序，在xilinx Spartan3E 上已经调试成功，拿出来与大家分享！