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VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.1 简单的可编程单脉冲发生器　　9.1.1 由系统功能描述时序关系　　9.1.2 流程图的设计　　9.1.3 系统功能描述　　

基于Verilog-HDL的硬件电路的实现 9.1 简单的可编程单脉冲发生器　　9.1.1 由系统功能描述时序关系　　9.1.2 流程图的设计　　9.1.3 系统功能描述　　9.1.4 逻辑框图　　9.1.5 延时模块的详细描述及仿真　　9.1.6 功能模块Verilog-HDL描述的模块化方法　　9.1.7 输入检测模块的详细描述及仿真　　9.1.8 计 ...

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VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.5 脉冲周期的测量与显示　　9.5.1 脉冲周期的测量原理　　9.5.2 周期计的工作原理　　9.5.3 周期测量模块的设计与实现

基于Verilog-HDL的硬件电路的实现 9.5 脉冲周期的测量与显示　　9.5.1 脉冲周期的测量原理　　9.5.2 周期计的工作原理　　9.5.3 周期测量模块的设计与实现　　9.5.4 forever循环语句的使用方法　　9.5.5 disable禁止语句的使用方法　　9.5.6 时标信号发生模块的设计与实现　　9.5.7 周期计的Verilog-HDL描述 ...

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VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.7 步进电机的控制　　9.7.1 步进电机驱动的逻辑符号　　9.7.2 步进电机驱动的时序图　　9.7.3 步进电机驱动的逻辑框图

基于Verilog-HDL的硬件电路的实现 9.7 步进电机的控制　　9.7.1 步进电机驱动的逻辑符号　　9.7.2 步进电机驱动的时序图　　9.7.3 步进电机驱动的逻辑框图　　9.7.4 计数模块的设计与实现　　9.7.5 译码模块的设计与实现　　9.7.6 步进电机驱动的Verilog-HDL描述　　　9.7.7 编译指令-"宏替换`define"的使用 ...

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matlab例程  谱估计 (1)修正协方差法 (2)多重信号分类（MUSIC）算法 (3)ESPRIT算法 (4)皮萨论科（Pisarenko）谐波分解法并对各算法进行分析。解压后即可在MATLAB上运

谱估计 (1)修正协方差法 (2)多重信号分类（MUSIC）算法 (3)ESPRIT算法 (4)皮萨论科（Pisarenko）谐波分解法并对各算法进行分析。解压后即可在MATLAB上运行

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微处理器开发  CRC16,CRC32,校验和实用计算工具,支持10,16进制 V1.1 增强了系统兼容性

CRC16,CRC32,校验和实用计算工具,支持10,16进制 V1.1 增强了系统兼容性

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数据结构  上下文无关文法（Context-Free Grammar, CFG）是一个4元组G=(V, T, S, P)

上下文无关文法（Context-Free Grammar, CFG）是一个4元组G=(V, T, S, P)，其中，V和T是不相交的有限集，S∈V，P是一组有限的产生式规则集，形如A→α，其中A∈V，且α∈(V∪T)*。V的元素称为非终结符，T的元素称为终结符，S是一个特殊的非终结符，称为文法开始符。设G=(V, T, S, P)是一个CFG，则G产生的语言是所有可由G ...

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书籍源码  本目录提供了<<ASP.NET+SQL Server数据库开发与实例>>一书从第4到第11章实例的核心源程序、数据库文件。

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其他  Visual Assist X 10.3.1549非常好的vc插件

Visual Assist X 10.3.1549非常好的vc插件，自动识别各种关键字，系统函数，成员变量，自动给出输入提示，自动更正大小写错误，自动标示错误，等等啦…… Visual Assist X

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汇编语言  .data val1 sword 0 val sword -276 .code main proc mov ax,val cwd mov bx,10 idiv bx

.data val1 sword 0 val sword -276 .code main proc mov ax,val cwd mov bx,10 idiv bx mov val1,ax call writebin call crlf mov ax,dx call writebin exit main endp end main

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其他  ABAP/4是SAP下的开发语言,此文件是全中文,属于最基础部分

ABAP/4是SAP下的开发语言,此文件是全中文,属于最基础部分

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