基于Verilog-HDL的硬件电路的实现 9.7 步进电机的控制 　　9.7.1 步进电机驱动的逻辑符号 　　9.7.2 步进电机驱动的时序图 　　9.7.3 步进电机驱动的逻辑框图 - 免费下载

VHDL/FPGA/Verilog资源 文件大小：3 K

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基于Verilog-HDL的硬件电路的实现 9.7 步进电机的控制 　　9.7.1 步进电机驱动的逻辑符号 　　9.7.2 步进电机驱动的时序图 　　9.7.3 步进电机驱动的逻辑框图 　　9.7.4 计数模块的设计与实现 　　9.7.5 译码模块的设计与实现 　　9.7.6 步进电机驱动的Verilog-HDL描述　 　　9.7.7 编译指令-"宏替换`define"的使用方法 　　9.7.8 编译指令-"时间尺度`timescale"的使用方法 　　9.7.9 系统任务-"$finish"的使用方法 　　9.7.10 步进电机驱动的硬件实现

源码文件列表

📂 共 6 个源码文件 点击文件名可在线查看源代码

1 📄
count_up_down_test.v
大小: 582 B
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2 📄
dec2_4_test.v
大小: 462 B
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3 📄
diriver.v
大小: 1.12 KB
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4 📄
dec2_4.v
大小: 514 B
查看源码
5 📄
count_up_down.v
大小: 402 B
查看源码
6 📄
diriver_test.v
大小: 566 B
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