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matlab例程  该模型用于搭建了一个基于时分割乘法器的电子式电能表的模型

该模型用于搭建了一个基于时分割乘法器的电子式电能表的模型

https://www.eeworm.com/dl/665/292394.html

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VHDL/FPGA/Verilog 使用硬件实现,效率较高的乘法器,通过FPGA验证的

使用硬件实现,效率较高的乘法器,通过FPGA验证的

https://www.eeworm.com/dl/663/294515.html

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单片机开发  LCD1602的4位和8位并行传输程序

LCD1602的4位和8位并行传输程序，用C51写的，硬件平台是51单片机。

https://www.eeworm.com/dl/648/295594.html

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加密解密  置图像低4位是0之后的图像

置图像低4位是0之后的图像，与源图像的区别

https://www.eeworm.com/dl/519/295607.html

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VHDL/FPGA/Verilog 里面是一个FIR滤波器的设计报告里面有具体的代码等等加法器乘法器见发起等等承平

里面是一个FIR滤波器的设计报告里面有具体的代码等等加法器乘法器见发起等等承平

https://www.eeworm.com/dl/663/298500.html

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单片机开发  利用4位共阴的动态显示器显示分与秒（利用定时器定时）

利用4位共阴的动态显示器显示分与秒（利用定时器定时）

https://www.eeworm.com/dl/648/300651.html

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VHDL/FPGA/Verilog 用VHDL语言采用串行方法实现用1位全加器实现4位全加器

用VHDL语言采用串行方法实现用1位全加器实现4位全加器

https://www.eeworm.com/dl/663/300759.html

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单片机开发  PROTEUS仿真用单片机系统板系统资源丰富： ★　内置RAM　32KB模块 ★　内置8位动态数码显示模块 ★　内置8X8点阵显示模块 ★　4位静态数码显示模块 ★　4位级联的74LS1

PROTEUS仿真用单片机系统板系统资源丰富： ★　内置RAM　32KB模块 ★　内置8位动态数码显示模块 ★　内置8X8点阵显示模块 ★　4位静态数码显示模块 ★　4位级联的74LS164串并转换模块 ★　内置8通道8位A/D转换 ★　内置8位D/A转换 ★　内置2路SPI和I2C总线接口 ★　内置4路1－Wire总线接口 ★　内置4X4矩阵式键盘 ★　内置 ...

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VHDL/FPGA/Verilog 4位ALU逻辑运算单元

4位ALU逻辑运算单元，可进行加法、减法、逻辑运算、移位等操作。

https://www.eeworm.com/dl/663/301849.html

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VHDL/FPGA/Verilog 高效结构的多输入浮点乘法器在FPGA上的实现

高效结构的多输入浮点乘法器在FPGA上的实现

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