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VHDL/FPGA/Verilog 32 risc cpu的参考设计

32 risc cpu的参考设计，内涵完整的testbench

https://www.eeworm.com/dl/663/391647.html

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VHDL/FPGA/Verilog 驱动时钟加入了PLL,使得DDS的驱动时钟可变.32位的NCO使得DDS的分辨率可以做到Hz量级

驱动时钟加入了PLL,使得DDS的驱动时钟可变.32位的NCO使得DDS的分辨率可以做到Hz量级

https://www.eeworm.com/dl/663/392388.html

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单片机开发  用 proteus + keil 实现一个00－99计数器里面用的是 AT89C51

用 proteus + keil 实现一个00－99计数器里面用的是 AT89C51

https://www.eeworm.com/dl/648/394439.html

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系统设计方案  计算机组成原理实验（MAX PLUS） 1.ALU设计 2.MEM设计 3.32位2选1选择器

计算机组成原理实验（MAX PLUS） 1.ALU设计 2.MEM设计 3.32位2选1选择器

https://www.eeworm.com/dl/678/395678.html

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其他嵌入式/单片机内容  凌阳SPCE3200 系统开发板随机自带源程序。共安排了32个子目录

凌阳SPCE3200 系统开发板随机自带源程序。共安排了32个子目录，其中按照SPCE3200实验指导书(上册)中的实验顺序存放了实验程序的源代码,所有项目代码均在S+coreIDE v2.1.2下测试通过。此为第24到第28个试验源代码。试验内容如下： 6.6 实验二十四：TFTP以太网通信实验 SPCE3200教学平台多媒体实验 7.1 实验二十五：MPEG4文 ...

https://www.eeworm.com/dl/687/397429.html

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其他嵌入式/单片机内容  凌阳SPCE3200多媒体开发板自带源程序。共安排了32个子目录

凌阳SPCE3200多媒体开发板自带源程序。共安排了32个子目录，其中按照SPCE3200实验指导书(上册)中的实验顺序存放了实验程序的源代码,所有项目代码均在S+coreIDE v2.1.2下测试通过。此为第29到第32个试验源代码。试验内容如下： 7.5 实验二十九：CMOS 视频采集实验 7.6 实验三十：LCD视频播放实验 7.7 实验三十一：Touch Pan ...

https://www.eeworm.com/dl/687/397439.html

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单片机开发  无线解码,用12864显示解码结果,00表示0,11表示1,01表示悬空

无线解码,用12864显示解码结果,00表示0,11表示1,01表示悬空

https://www.eeworm.com/dl/648/400792.html

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VHDL/FPGA/Verilog 此模块用于"PS/2接口的鼠标或键盘"与"具有外部读写的8位并口单片机"双向通信模块. Verilog HDL语言编写,在Quartus II 8.1 (32-Bit)软件中编译,并下载至EPM7

此模块用于"PS/2接口的鼠标或键盘"与"具有外部读写的8位并口单片机"双向通信模块. Verilog HDL语言编写,在Quartus II 8.1 (32-Bit)软件中编译,并下载至EPM7128SLC84-10芯片中通过. 文件中有详细的注解. 此模块具有对于PS/2时钟和数据线的滤波功能,这样减少外部干扰，保证通信的可靠性！ ...

https://www.eeworm.com/dl/663/406899.html

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操作系统开发  SimpleGraphicOperatingSystem 32位图形化操作系统多进程支持FAT32 详见www.sgos.net.cn

SimpleGraphicOperatingSystem 32位图形化操作系统多进程支持FAT32 详见www.sgos.net.cn

https://www.eeworm.com/dl/531/407447.html

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单片机开发  sd0432 是一款段码式液晶驱动lcd 具有32*4段驱动、

sd0432 是一款段码式液晶驱动lcd 具有32*4段驱动、

https://www.eeworm.com/dl/648/407792.html

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