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https://www.eeworm.com/dl/663/152701.html
VHDL/FPGA/Verilog
16位高速加法器
16位高速加法器，采用verilog语言编写，已经成功仿真，能够运行
https://www.eeworm.com/dl/744749.html
技术资料
机器视觉高速相机镜头焦距
该文档为机器视觉高速相机镜头焦距简介资料，讲解的还不错，感兴趣的可以下载看看…………………………
https://www.eeworm.com/dl/837633.html
技术资料
高速串行SERDES以及应用介绍
SERDES是英文SERializer(串行器)/DESerializer(解串器)的简称。它是一种时分多路复用(TDM)、点对点的通信技术，即在发送端多路低速并行信号被转换成高速串行信号，经过传输媒体(光缆或铜线)，最后在接收端高速串行信号重新转换成低速并行信号。这种点对点的串行通信技术充分利用传输媒体的信道容量，减 ...