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找到约 1,237 项符合 零漂移 的查询结果

其他 使用LabVIEW编写的一个计算器程序。 计算器能完成的运算: 加减乘除

使用LabVIEW编写的一个计算器程序。 计算器能完成的运算: 加减乘除,求平方,求立方,求自然对数,求以10为底的对数,求阶乘求正弦余弦正切值,符号取反 能完成的操作:角度与弧度的切换,退格,清零 缺点:由于显示使用的是数值类型,所以无法实现小数输入;只能进行十进制的计算,不支持其它进制,统计功能未实现 ...
https://www.eeworm.com/dl/534/349259.html
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Applet 1.1号多机:   只要在系统注册页面提交企业真实资料并通过审核

1.1号多机:   只要在系统注册页面提交企业真实资料并通过审核,将获得特殊号段的专属企业QQ号码。该号码可以同时在多台机器上登录系统,内部以不同工号区分,各工号之间可以根据情况互相转接。   2.Web页面的会话:   企业无需安装任何软件,只要登录系统地址就可以开始操作。所有会话过程都发生在网页端, ...
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VHDL/FPGA/Verilog 是vhdl语言

是vhdl语言,在fpga开发板上实现十进制技术(7段数码管显示),包括复位,清零,计数使能。
https://www.eeworm.com/dl/663/351426.html
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通讯/手机编程 ISD1420为美国ISD公司出品的优质单片语音录放电路

ISD1420为美国ISD公司出品的优质单片语音录放电路,由振荡器、语音存储单元、前置放大器、自动增 益控制电路、抗干扰滤波器、输出放大器组成。一个最小的录放系统仅由一个麦克风、一个喇叭、两个按钮、一 个电源、少数电阻电容组成。录音内容存入永久存储单元,提供零功率信息存储,这个独一无二的方法是借助于 美国ISD公司 ...
https://www.eeworm.com/dl/527/351600.html
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VHDL/FPGA/Verilog 8位十六进制频率计设计 根据频率的定义和频率测量的基本原理

8位十六进制频率计设计 根据频率的定义和频率测量的基本原理,测定信号的频率必须有一个脉宽为1s的输入信号脉冲计数允许信号;1s计数结束后,计数值被锁入锁存器,计数器清零,为下一测频计数周期做好准备。测频控制信号可由一个独立的发生器(FTCTRL)来产生。 ...
https://www.eeworm.com/dl/663/353706.html
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其他书籍 介绍了一种用于心电监护的数字滤波算法

介绍了一种用于心电监护的数字滤波算法,对滤波器的设计,包括滤波原理、整系数数字滤波器 的波型特征、实现方框图及10 点平均数字滤波器进行了分析,并给出心电信号的滤波效果图。实验结果表明, 该算法能有效滤除基线漂移和工频干扰,算法简单实用。 ...
https://www.eeworm.com/dl/542/354133.html
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matlab例程 matlab实现对声音信号短时能量

matlab实现对声音信号短时能量,短时过零率的计算。
https://www.eeworm.com/dl/665/355774.html
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压缩解压 介绍小波的函数

介绍小波的函数,不是很复杂,初学者应该会有很大的帮助,嵌入式零树的代码
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汇编语言 开始时

开始时,显示“00”,第1次按下SP1后就开始计时。 第2次按SP1后,计时停止。 第3次按SP1后,计时归零。
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系统设计方案 1. 完成时/分/秒的依次显示并正确计数

1. 完成时/分/秒的依次显示并正确计数,利用六位数码管显示; 2. 时/分/秒各段个位满10正确进位,秒/分能做到满60向前进位,有系统时间清零功能; 3. 定时器:实现整点报时,通过扬声器发出高低报时声音; 4. 时间设置,也就是手动调时功能:当认为时钟不准确时,可以分别对分/时钟进行调整; 5. 闹钟:实现分/时闹钟 ...
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