8位十六进制频率计设计根据频率的定义和频率测量的基本原理 - 免费下载

VHDL/FPGA/Verilog资源文件大小：240 K

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未知

所属分类

VHDL/FPGA/Verilog

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2013-12-26 23:44

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240 K

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资源简介

8位十六进制频率计设计根据频率的定义和频率测量的基本原理，测定信号的频率必须有一个脉宽为1s的输入信号脉冲计数允许信号；1s计数结束后，计数值被锁入锁存器，计数器清零，为下一测频计数周期做好准备。测频控制信号可由一个独立的发生器（FTCTRL）来产生。

源码文件列表

📂 共 107 个源码文件点击文件名可在线查看源代码

1 📄

u1961127.dls

2 📄

reg32b.acf

大小: 15.31 KB

3 📄

freqtest8.hif

大小: 6.87 KB

4 📄

ftctrl.vhd

大小: 798 B

5 📄

freqtest.pin

大小: 4.44 KB

6 📄

freqtest(6).cnf

7 📄

u3477010.dls

8 📄

freqtest8(9).cnf

9 📄

reg32b.sym

10 📄

ftctrl.pof

11 📄

u9235333.dls

12 📄

freqtest(1).cnf

13 📄

freqtest.fit

大小: 10.92 KB

14 📄

freqtest8(4).cnf

15 📄

freqtest(7).cnf

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#8位 #十六进制 #频率计设 #频率

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