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VHDL/FPGA/Verilog 分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL
分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太严格的设计，通过自主设计进行时钟分频的实现方法仍然非常流行。首先这种方法可以节省锁相环资源，再者，这种方式只消耗不多的逻辑单 ...
单片机开发 LCD12864显示 便携式 电池,压力,电流三输入表 单次读数 1240E 各通道增益不同 非线性自校准, x5165分配:0-0708H ( 25组计量数据 ) 校准 07d8h--07ec
LCD12864显示 便携式 电池,压力,电流三输入表 单次读数 1240E 各通道增益不同 非线性自校准,
x5165分配:0-0708H ( 25组计量数据 ) 校准 07d8h--07ec (21单元分区)对应C8-dbh
组数07f0-07f1H 计量开关07f2H (不清除), 数据格式07F3H 读电流零值0f74h-07f6h
压力自动量程编号 < > 键显示电池/量程, 按 "+" ＂-＂键电流清零 ...
其他 哈夫曼编码的步骤: (1). 把信源符号按概率大小顺序排列
哈夫曼编码的步骤:
(1). 把信源符号按概率大小顺序排列， 并设法按逆次序分配码字的长度。
(2). 在分配码字长度时，首先将出现概率 最小的两个符号的概率相加合成一个概率
(3). 把这个合成概率看成是一个新组合符号地概率，重复上述做法直到最后只剩下两个符号概率为止。
(4). 完成以上概率顺序排列后，再反过来逐步向 ...
其他 信息论与编?氲牟街? (1). 把信源符号按概率大小顺序排列
信息论与编?氲牟街?
(1). 把信源符号按概率大小顺序排列， 并设法按逆次序分配码字的长度。
(2). 在分配码字长度时，首先将出现概率 最小的两个符号的概率相加合成一个概率
(3). 把这个合成概率看成是一个新组合符号地概率，重复上述做法直到最后只剩下两个符号概率为止。
(4). 完成以上概率顺序排列后，再反过来逐步向 ...
Internet/网络编程 计算机网络技术的实用课件
计算机网络技术的实用课件，可以知道你从零学起。
Java编程 java咖啡馆,在这个连载中
java咖啡馆,在这个连载中，我将为你介绍Java编程技术，以及Java程序的开发方法，从零开始，循序渐进，希望能够让你亲自品味Java这种咖啡的香醇与浓郁。
如果说看完这个连载你便能全面掌握Java技术
VHDL/FPGA/Verilog verilog HDL自动投币售饮料机程序
verilog HDL自动投币售饮料机程序，分一元和五毛，有找零功能。
VHDL/FPGA/Verilog 本压缩包含有一个自动售邮票机
本压缩包含有一个自动售邮票机，可以选择购买6角，8角的邮票。
可以投入1角，5角，1元的硬币，改程序可实现自动找零，所选邮票面值显示（对应二极管发光），投币不足可以退币
汇编语言 1. 计算器实现的功能 （1）整数的加、减、乘、除运算； （2）小数的加、减运算
1. 计算器实现的功能
（1）整数的加、减、乘、除运算；
（2）小数的加、减运算，包含小数加、减整数；
（3）运算出错后报错，并重新开始。
（4）LED显示输出
2. 运算状态下，报错的几种情况（按‘=’后重新开始）
（1）应该输入数字时，按符号，即第一个输入的数字是符号；
（2）两数之和大于四位数；
（3）两数之差为负 ...
VHDL/FPGA/Verilog 该程序实现一个数字钟
该程序实现一个数字钟，带调整时间功能，在调整时间时，对应的位置闪烁显示。
CLR 为清零端，该键为‘1’时，时钟显示”000000“；
EN 计数使能端，该键为‘1’时，时钟停止；
MODE 模式选择按钮，在4种模式下循环：正常-小时调整-分调整-秒调整。
INC 调整时间按钮，该键为‘1’时，对应位置加1； ...