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运算器 的查询结果
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VHDL/FPGA/Verilog 移位运算器SHIFTER 使用Verilog HDL 语言编写
移位运算器SHIFTER 使用Verilog HDL 语言编写，其输入输出端分别与键盘/显示器LED 连接。移位运算器是时序电路，在J钟信号到来时状态产生变化， CLK 为其时钟脉冲。由S0、S1 、M 控制移位运算的功能状态，具有数据装入、数据保持、循环右移、带进位循环右移，循环左移、带进位循环左移等功能。
CLK 是时钟脉冲输入，通过键5 ...
VHDL/FPGA/Verilog 一个四位二进制加/减运算器。 要求：当控制端G＝0时做加运算
一个四位二进制加/减运算器。
要求：当控制端G＝0时做加运算，G＝1时做减运算。用发光二极管表示运算结果的正、负。用数码管显示运算结果：加运算时，相加之和不超过15，减运算时，结果可正可负，但都用原码表示。
VHDL/FPGA/Verilog 本人主要是介绍CPU和运算器级联的程序
本人主要是介绍CPU和运算器级联的程序，采用的是VHDL语言
Java编程 用java编写的简单运算器
用java编写的简单运算器，能实现一些基本运算
数据结构 稀疏矩阵运算器 对稀疏矩阵采用三元组存储
稀疏矩阵运算器 对稀疏矩阵采用三元组存储，实现加法 减法 乘法的功能
Java编程 用Netbean编写的图形用户界面设计实验 包括绘制正弦曲线和市属四则运算器
用Netbean编写的图形用户界面设计实验 包括绘制正弦曲线和市属四则运算器
学术论文 基于FPGA的计算机组成原理实验系统的设计与仿真.rar
“计算机组成原理”是计算机专业的一门核心课程。传统的计算机组成原理实验是在指令格式、寻址方式、运算器、控制器、存储器等都相对固定的情况下进行，学生主要进行功能实现和验证，缺少自主设计和创新过程。 为改变这种状况，须更新现有的计算机组成原理实验系统。采用FPGA芯片作为载体，使用EDA开发工具，用硬件描述语言 ...
学术论文 基于FPGA的PID控制器研究与实现.rar
基于微处理器的数字PID控制器改变了传统模拟PID控制器参数整定不灵活的问题。但是常规微处理器容易在环境恶劣的情况下出现程序跑飞的问题，如果实现PID软算法的微处理器因为强干扰或其他原因而出现故障，会引起输出值的大幅度变化或停止响应。而FPGA的应用可以从本质上解决这个问题。因此，利用FPGA开发技术，实现智能控制 ...