搜索：输出可调
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https://www.eeworm.com/dl/kbcluoji/40219.html
可编程逻辑
GD-06 ALLEGRO通用GSM拨号器
D-06  ALLEGRO 是通用型的GSM拨号器和控制器，它既可以用于家庭又可以用于工业自动控制，用于安全防范或远程数据传输工程，触发任何一个输入端将会使得该装置以短信的方式发送报告到已编好程的电话号码上或直接打电话，通过发送特定的短信到该装置上，你可以打开或关闭远端控制输出端。基本设定是 ...
https://www.eeworm.com/dl/544/41834.html
测试测量
电源的线负载瞬态响应测试
有关线和负载瞬态响应的电源指标说明了电源对于突变的线电压和负载电流的响应情况。监视电源在这样的瞬态过程中试图维持稳定的行为，你会观察到输出发生过冲或振荡的趋势。
线和负载瞬态过程实际上是一个向电源注入扰动的阶跃函数。负载瞬态过程通过一个阶跃的负载电流向输出注放扰动，而线瞬 ...
https://www.eeworm.com/dl/648/209760.html
单片机开发
本系统是以凌阳SPCE061A单片机为核心控制器
本系统是以凌阳SPCE061A单片机为核心控制器，具有电流可预置、可步进调整、输出的电流信号和预置的电流信号可同时显示的数控直流电流源。系统主要包括：凌阳SPCE061A精简开发板、键盘与显示电路、压控恒流源电路、校正电路、电源电路等。系统中通过键盘按键对电流值进行预置，凌阳SPCE061A单片机送出相 ...
https://www.eeworm.com/dl/654/210875.html
数据结构
创建一棵二叉排序树
创建一棵二叉排序树，并采用中序遍历和层次遍历法输出其顶点序列，主要实验内容如下：
1. 定义二叉排序树的结构BiTree；
2. 编制二叉排序树的插入算法：void Insert_SortTree (BiTree ST, ElemType x)；
3. 编制中序遍历函数；
4. 在main()函数中完成二叉排序树的建立，以及中序遍历的输出。（二叉排序 ...
https://www.eeworm.com/dl/534/225795.html
其他
波束形成就是从传感器阵列重构源信号。（1）、通过增加期望信源的贡献来实现；（2）、通过抑制掉干扰源来实现。经典的波束形成需要观测方向(期望信源的方向)的知识。盲波束形成试图在没有期望信源方向信息的情况
波束形成就是从传感器阵列重构源信号。（1）、通过增加期望信源的贡献来实现；（2）、通过抑制掉干扰源来实现。经典的波束形成需要观测方向(期望信源的方向)的知识。盲波束形成试图在没有期望信源方向信息的情况下进行信源的恢复。
波束形成技术的基本思想是：通过将各阵元输出进行加权求和，在一时间 ...
https://www.eeworm.com/dl/637/226586.html
多国语言处理
pyformat.zip包中有两个文件夹
pyformat.zip包中有两个文件夹，pyformat_src文件夹里的为源代码，pyformat_dist文件夹里的为编译后的exe可执行程序，另外每个文件夹里都放了一个名为“testfile.txt”的测试文件。
源码使用方法示例：执行"python pyformat.py testfile.txt"。
可执行程序使用方法示例：执行“pyformat testfile.txt” ...
https://www.eeworm.com/dl/665/288468.html
matlab例程
（1）变换模块 本模块包含两部分内容：利用 反变换规则将 坐标系下的两相电流转换成三相电流；利用间接矢量控制
（1）变换模块
本模块包含两部分内容：利用 反变换规则将 坐标系下的两相电流转换成三相电流；利用间接矢量控制，得到转子角位移，公式如下（2） 电流滞环控制器(Hysteresis current controller)模块（3） 电压源型逆变器(Voltage sourse inverter,VSI)模块
（4） 变换模块（5） 感应电机(IM)模块
该感 ...
https://www.eeworm.com/dl/518/352461.html
数值算法/人工智能
正整数x 的约数是能整除x 的正整数。正整数x 的约数个数记为div(x)。例如
正整数x 的约数是能整除x 的正整数。正整数x 的约数个数记为div(x)。例如，1，2，5，10 都是正整数10 的约数，且div(10)=4。设a 和b 是2 个正整数，a≤b，找出a 和b之间约数个数最多的数x。
对于给定的2 个正整数a≤b，编程计算a 和b 之间约数个数最多的数。
数据输入
输入数据由文件名为input.txt的 ...
https://www.eeworm.com/dl/663/353703.html
VHDL/FPGA/Verilog
7段数码显示译码器设计7段数码是纯组合电路
7段数码显示译码器设计7段数码是纯组合电路，通常的小规模专用IC，如74或4000系列的器件只能作十进制BCD码译码，然而数字系统中的数据处理和运算都是二进制的，所以输出表达都是十六进制的，为了满足十六进制数的译码显示，最方便的方法就是利用译码程序在FPGA/CPLD中来实现。例子作为七段译码器，输出 ...
https://www.eeworm.com/dl/668/377013.html
其他行业
Description 将m个孩子从1到m编上号
Description
将m个孩子从1到m编上号，按序号围坐成一个圈，从1号孩子开始数，每数到n时，被数到的孩子即离开圈子，然后从下一个孩子开始，再从1开始数，如此不断地数下去，只到只剩下最后一个孩子，问剩下的孩子是几号？
Input
输入为一组整数对，每个整数对占一行，整数对的第一个整数表示m，即孩 ...