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单片机开发 LCD12864显示 便携式 电池,压力,电流三输入表 单次读数 1240E 各通道增益不同 非线性自校准, x5165分配:0-0708H ( 25组计量数据 ) 校准 07d8h--07ec

LCD12864显示 便携式 电池,压力,电流三输入表 单次读数 1240E 各通道增益不同 非线性自校准, x5165分配:0-0708H ( 25组计量数据 ) 校准 07d8h--07ec (21单元分区)对应C8-dbh 组数07f0-07f1H 计量开关07f2H (不清除), 数据格式07F3H 读电流零值0f74h-07f6h 压力自动量程编号 < > 键显示电池/量程, 按 "+" "-"键电流清零 ...
https://www.eeworm.com/dl/648/311348.html
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VHDL/FPGA/Verilog 该程序实现一个数字钟

该程序实现一个数字钟,带调整时间功能,在调整时间时,对应的位置闪烁显示。 CLR 为清零端,该键为‘1’时,时钟显示”000000“; EN 计数使能端,该键为‘1’时,时钟停止; MODE 模式选择按钮,在4种模式下循环:正常-小时调整-分调整-秒调整。 INC 调整时间按钮,该键为‘1’时,对应位置加1; ...
https://www.eeworm.com/dl/663/318797.html
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汇编语言 再KEIL C51环境中

再KEIL C51环境中,对存储器块清零,设置RAM中的起始地址
https://www.eeworm.com/dl/644/323239.html
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数据结构 11. 停车场管理2(9) (1) 有一个两层的停车场, 每层有6个车位, 当第一层车停满后才允许使用第二层. ( 停车场可用一个二维数组实现, 每个数组元素存放一个车牌号 ) 每辆车的信息包括车牌

11. 停车场管理2(9) (1) 有一个两层的停车场, 每层有6个车位, 当第一层车停满后才允许使用第二层. ( 停车场可用一个二维数组实现, 每个数组元素存放一个车牌号 ) 每辆车的信息包括车牌号, 层号, 车位号, 停车时间共4项. 其中停车时间按分钟计算 (2) 假设停车场初始状态为第一层已经停有4辆车, 其车位号依次为1—4 , ...
https://www.eeworm.com/dl/654/327436.html
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软件设计/软件工程 题目:电子时钟的设计 一、实验目的: 1. 掌握多位计数器相连的设计方法。 2. 掌握十进制、六十进制、二十四进制计数器的设计方法。 3. 继续巩固多位数码管的驱动及编码。 4. 掌握扬声器

题目:电子时钟的设计 一、实验目的: 1. 掌握多位计数器相连的设计方法。 2. 掌握十进制、六十进制、二十四进制计数器的设计方法。 3. 继续巩固多位数码管的驱动及编码。 4. 掌握扬声器的驱动 5. 掌握EPLD技术的层次化设计方法 二、实验要求: 1.用时、分、秒计数显示功能,以24小时循环计时。 2.具用清零,调节小 ...
https://www.eeworm.com/dl/684/330659.html
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单片机开发 利用单片机的定时器/计数器的定时和计数

利用单片机的定时器/计数器的定时和计数,用 LED数码显示计时的时间,某键按下去时 再按一下停止计时 另一键按下去时间清零。源程序+电路图。
https://www.eeworm.com/dl/648/334197.html
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汇编语言 目前已有若干版本的子程序库公开发表

目前已有若干版本的子程序库公开发表,它们各有特色。本程序库中的开平方算法为快速逼 近算法,它能达到牛顿迭代法同样的精度,而速度加快二十倍左右,超过双字节定点除法的 速度。 本子程序库对《单片机应用程序设计技术》一书附录中的子程序库作了重大修订: (1)按当前流行的以 IBM PC 为主机的开发系统对汇编语言的 ...
https://www.eeworm.com/dl/644/346022.html
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其他 使用LabVIEW编写的一个计算器程序。 计算器能完成的运算: 加减乘除

使用LabVIEW编写的一个计算器程序。 计算器能完成的运算: 加减乘除,求平方,求立方,求自然对数,求以10为底的对数,求阶乘求正弦余弦正切值,符号取反 能完成的操作:角度与弧度的切换,退格,清零 缺点:由于显示使用的是数值类型,所以无法实现小数输入;只能进行十进制的计算,不支持其它进制,统计功能未实现 ...
https://www.eeworm.com/dl/534/349259.html
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VHDL/FPGA/Verilog 是vhdl语言

是vhdl语言,在fpga开发板上实现十进制技术(7段数码管显示),包括复位,清零,计数使能。
https://www.eeworm.com/dl/663/351426.html
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VHDL/FPGA/Verilog 8位十六进制频率计设计 根据频率的定义和频率测量的基本原理

8位十六进制频率计设计 根据频率的定义和频率测量的基本原理,测定信号的频率必须有一个脉宽为1s的输入信号脉冲计数允许信号;1s计数结束后,计数值被锁入锁存器,计数器清零,为下一测频计数周期做好准备。测频控制信号可由一个独立的发生器(FTCTRL)来产生。 ...
https://www.eeworm.com/dl/663/353706.html
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