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汇编语言  电子警报器设计

电子警报器设计，是在TND－MD教学系统上实现的，所使用的芯片主要有8253定时计数器、8259A中断控制器、8255A并行接口电路芯片。通过按键实现报警与不报警的功能。源代码在文档最后，附有注释。

https://www.eeworm.com/dl/644/307061.html

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Java编程  Java: 在n 张扑克牌中找出顺子题目是这样的：有n张扑克牌

Java: 在n 张扑克牌中找出顺子题目是这样的：有n张扑克牌，每张牌的取值范围是：2，3，4，5，6，7，8，9，10，J，Q，K，A。在这n张牌中找出顺子（5张及5张以上的连续的牌），并将这些顺子打印出来。思路：我的思路其实很简单，首先就是要去掉重复的牌，因为同样的顺子之算一个，显然JAVA中的Set很适合这个工作。同时又 ...

https://www.eeworm.com/dl/633/307221.html

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VHDL/FPGA/Verilog 分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL

分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太严格的设计，通过自主设计进行时钟分频的实现方法仍然非常流行。首先这种方法可以节省锁相环资源，再者，这种方式只消耗不多的逻辑单 ...

https://www.eeworm.com/dl/663/308242.html

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VHDL/FPGA/Verilog UART发送TX控制电路设计

UART发送TX控制电路设计，以波特率产生器的EnableTX将数据DATAO以LOAD信号将其送入发送缓冲器Tbuff，并令寄存器内容已载有数据而非空出的标志tmpTBufE=0。当同步波特率信号来临时监视是否处于tmpTBufE=0（内有数据）以及tmpTRegE=1（没有数据）。即处于尚未启动发送态则将Tbuff缓冲寄存器送入传输寄存器Treg内并令tmpTRegE ...

https://www.eeworm.com/dl/663/311884.html

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VHDL/FPGA/Verilog 50个VHDL常用的模块

50个VHDL常用的模块，包括计数器，译码器，编码器，锁存器等等,可供参考

https://www.eeworm.com/dl/663/312754.html

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其他数据库  简单入门新闻发布系统源码具有新闻的添加、管理及显示等基本功能(可以进行图片上传

简单入门新闻发布系统源码具有新闻的添加、管理及显示等基本功能(可以进行图片上传，有浏览计数器)，功能非常简单，采用Access数据库页面布局简单，适合入门者学习之用，系统采用Access数据库，默认管理员密码为51aspx

https://www.eeworm.com/dl/645/313345.html

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汇编语言  测频仪自问世以来得到蓬勃发展

测频仪自问世以来得到蓬勃发展，目前测频仪的功能正日渐完善。在电路实验中测量频率是一项十分重要的工作，基于计数器的功能设计了一个利用数字电路构成的可用来测量某些电信号频率的仪器，该仪器适合测量频率较高的电信号，具有电路简洁、测试范围广等优点。 ...

https://www.eeworm.com/dl/644/317076.html

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VHDL/FPGA/Verilog 本文件包括多路选择器器建模

本文件包括多路选择器器建模，译码器实验程序，加法器实验程序，比较器实验程序，计数器建模，I2C接口标准建模源码，串行接口RS232标准建模源码标准，LCM建模源码，时钟６分频源码，串并转化源码。，对于硬件设计初学者来说有一定的参考价值。 ...

https://www.eeworm.com/dl/663/318858.html

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VHDL/FPGA/Verilog 简单可编程中断控制器

简单可编程中断控制器，利用定时计数器的中断请求信号输出中断使能控制信号。

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单片机开发  有关Atmega8的protues的仿真部分

有关Atmega8的protues的仿真部分，除前言外共六部分： 1.基本IO的学习Led部分； 2.基本IO：按键部分； 3.外部中断； 4.定时，计数器； 5.串口通信； 6.IIC通信。我是老杨，该文档的作者，这份文档是在学习单片机的时候写的，没有把计划写的写完，但这是当时写的最全的一份了。 ...

https://www.eeworm.com/dl/648/319534.html

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