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VHDL/FPGA/Verilog 1．6个数码管静态显示驱动 2．按键模式选择(时分秒)与调整控制 3．用硬件描述语言(或混合原理图)设计时、分、秒计数器模块、按键控制状态机模块、显示译码模块、顶层模块。要求使用实验箱右下角的6个

1．6个数码管静态显示驱动 2．按键模式选择(时\分\秒)与调整控制 3．用硬件描述语言(或混合原理图)设计时、分、秒计数器模块、按键控制状态机模块、显示译码模块、顶层模块。要求使用实验箱右下角的6个静态数码管(DS8C, DS7C, DS4B, DS3B, DS2B, DS1B)显示时、分、秒；要求模式按键和调整按键信号都取自经过防抖处理后的按 ...

https://www.eeworm.com/dl/663/327835.html

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其他  包含了四位计数器等基本数字模块的的verilog HDL程序代码,该功能实现,可以直接利用DC进行综合,得到硬件电路,亦能够转换成VHDL语言进行综合

包含了四位计数器等基本数字模块的的verilog HDL程序代码,该功能实现,可以直接利用DC进行综合,得到硬件电路,亦能够转换成VHDL语言进行综合

https://www.eeworm.com/dl/534/328513.html

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数据库系统  一款优秀的网站访问计数器

一款优秀的网站访问计数器，数据库为access。

https://www.eeworm.com/dl/523/329749.html

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软件设计/软件工程  题目：电子时钟的设计一、实验目的： 1．掌握多位计数器相连的设计方法。 2．掌握十进制、六十进制、二十四进制计数器的设计方法。 3．继续巩固多位数码管的驱动及编码。 4．掌握扬声器

题目：电子时钟的设计一、实验目的： 1．掌握多位计数器相连的设计方法。 2．掌握十进制、六十进制、二十四进制计数器的设计方法。 3．继续巩固多位数码管的驱动及编码。 4．掌握扬声器的驱动 5．掌握EPLD技术的层次化设计方法二、实验要求： 1．用时、分、秒计数显示功能，以24小时循环计时。 2．具用清零，调节小 ...

https://www.eeworm.com/dl/684/330659.html

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单片机开发  利用定时计数器功能

利用定时计数器功能，来完成对输入的信号进行频率计数

https://www.eeworm.com/dl/648/330687.html

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VHDL/FPGA/Verilog 数字系统设计中的全加器、10进制计数器、2-4译码器、摩尔状态机、2-1路选择器的源代码

数字系统设计中的全加器、10进制计数器、2-4译码器、摩尔状态机、2-1路选择器的源代码

https://www.eeworm.com/dl/663/331708.html

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汇编语言  按照音符来设定频率和8253定时/计数器的延时时间。8253的CLK0接1MHz时钟

按照音符来设定频率和8253定时/计数器的延时时间。8253的CLK0接1MHz时钟，GATE0接＋5V，OUT0接8255的PA0,J1接喇叭，编程使计算机的数字键1、2、3、4、5、6、7作为电子琴按键，按下即发出相应的音阶。要求： (1)层以8255接八个开关K1~K8，做电子琴按键输入。 (2) 以8253控制扬声器，拨动不同的开关，发出相应的音阶。 ...

https://www.eeworm.com/dl/644/332166.html

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游戏  java编写的猜数字游戏有计数器提示功能

java编写的猜数字游戏有计数器提示功能

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汇编语言  用汇编编写的8253计数器器代码。适用于8086开发环境。里面有原理图哦。供大家参考参考。

用汇编编写的8253计数器器代码。适用于8086开发环境。里面有原理图哦。供大家参考参考。

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单片机开发  利用单片机的定时器/计数器的定时和计数

利用单片机的定时器/计数器的定时和计数，用 LED数码显示计时的时间，某键按下去时再按一下停止计时另一键按下去时间清零。源程序+电路图。

https://www.eeworm.com/dl/648/334197.html

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