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comsol声学模块简介

声学模块由一系列物理场接口组成，用于模拟流体和固体中的声音传播。在声学模块中，可用的物理场接口包括压力声学接口，声-固耦合接口，气动声学接口，热粘性声学接口和几何声学接口。使用声学模块可以很轻松地求解一些经典的声学问题，例如，声散射场、声衍射、声激发、声辐射，以及声传输，等等。这 ...
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CS8900A底层操作说明

1.CS8900A简介CS8900A集成了构建一个完整的以太网电路所需的全部模拟和数字电路，是一种真正的单芯片、全双工以太网解决方案。它的主要功能模块包括：■直接ISA总线接口■802.3MAC引擎■集成的缓冲寄存器■串行EEPROM接口■完整的模拟前端（包括10BASE-T和AUI）2.CS8900A配置正常运行时，CS8900A执行两 ...
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https://www.eeworm.com/dl/845684.html 技术资料

CADENCE硬件仿真器在Ethernet交换芯片验证中的应用

该文档为CADENCE硬件仿真器在Ethernet交换芯片验证中的应用讲解文档，本文介绍了应用 CADENCE 硬件仿真器 Palladium 快速灵活验证 Ethernet 交换芯片的 实例。 关键词：Palladium 硬件仿真器 Ethernet 以太网 IC 验证 1 概述 随着网络通信的高速发展，集成多种内容的以太网交换芯片在网 ...
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https://www.eeworm.com/dl/514/8847.html 学术论文

基于PIC16F877A的温室自动控制系统的研究.rar

温室是设施农业的重要组成部分，国内外温室种植业的实践经验表明，提高温室的自动控制和管理水平可充分发挥温室农业的高效性。随着传感技术，计算机技术及通讯技术的迅猛发展，现代化温室信息自动采集及智能控制系统的开发已越来越引起人们的重视，并成为一个具有重要意义的研究方向。因此设计了基于PI ...
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https://www.eeworm.com/dl/895584.html 技术资料

基于PIC16F877A的温室自动控制系统的研究.rar

温室是设施农业的重要组成部分，国内外温室种植业的实践经验表明，提高温室的自动控制和管理水平可充分发挥温室农业的高效性。随着传感技术，计算机技术及通讯技术的迅猛发展，现代化温室信息自动采集及智能控制系统的开发已越来越引起人们的重视，并成为一个具有重要意义的研究方向。因此设计了基于PI ...
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VIP专区-PCB源码精选合集系列（13）

VIP专区-PCB源码精选合集系列（13）资源包含以下内容：1. 华为PCB的EMC设计指南.2. PCB设计高级培训.3. 高速电路板设计技术.4. PADSLayout很好的参考资料.5. HyperLynx仿真教程.6. Allegro15.X培训教材.7. 各种集成芯片的封装尺寸.8. FPC模组软板设计规范.9. 自己总结pcb抗干扰问题.10. 正版免费的pcb ...
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于博士 Cadence16.5入门视频教程 60讲全

文件较大，附件提供了百度网盘的分享地址和提取码，打开即可下载或转存。中文名: 于博士之Cadence SPB 15.7 快速入门视频教程(共60集)英文名: Cadence SPB 15.7发行时间: 2009年地区: 大陆对白语言: 普通话文字语言: 简体中文简介: 教程定位：零基础快速入门教程，实实在在为初学者着想。远离学院 ...
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https://www.eeworm.com/dl/514/10057.html 学术论文

IEEE 802.16a RS-CC编译码VLSI算法研究及FPGA实现

　　本论文依据IEEE802.16a物理层对RS-CC码的参数要求，研究了RS-CC码的高速编、译码的VLSI硬件算法，同时对FPGA开发技术进行了研究，以VerilogHDL为描述语言，在Xilinx公司的FPGA上实现了高速的RS-CC编、译码器。RS译码器中，错误位置多项式和错误值多项式的求解采用无求逆单元，并具有规则数据流、易 ...
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https://www.eeworm.com/dl/542/176257.html 其他书籍

本手册是 Rainer s DHTML Library 产品的一部分。 　　本手册针对的是已有一定网页设计制作经验的读者。其目的是提供完整清晰的样式表内容的快速索引及进阶帮助。所以对于网页制作和

本手册是 Rainer s DHTML Library 产品的一部分。 　　本手册针对的是已有一定网页设计制作经验的读者。其目的是提供完整清晰的样式表内容的快速索引及进阶帮助。所以对于网页制作和样式表的基础知识，仅简单介绍，恕不赘述。 　　手册提供了完整的 CSS2.0 的属性(Properties)、规则(At-Rules)、伪类 ...
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https://www.eeworm.com/dl/663/200856.html VHDL/FPGA/Verilog

用verilog设计密勒解码器 一、题目： 设计一个密勒解码器电路 二、输入信号： 1． DIN：输入数据 2． CLK：频率为2MHz的方波

用verilog设计密勒解码器 一、题目： 设计一个密勒解码器电路 二、输入信号： 1． DIN：输入数据 2． CLK：频率为2MHz的方波，占空比为50％ 3． RESET：复位信号，低有效 三、输入信号说明： 输入数据为串行改进密勒码，每个码元持续时间为8μs，即16个CLK时钟；数据流是由A、B、C三种信号组成； A： ...
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