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秒表设计 的查询结果
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VHDL/FPGA/Verilog 用Verilog HDL编写的秒表设计
用Verilog HDL编写的秒表设计，可以实现百分之一秒，十分之一秒，秒，十秒等功能。
技术资料 基于FPGA的秒表设计与实现
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技术资料 51单片机电子秒表设计(Proteus)
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可编程逻辑 基于CPLD的VHDL语言数字钟(含秒表)设计
利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点。
本设计采用自顶向下、混合输入方式（原理图输入—顶层文件连接和VH ...
测试测量 Multisim10在电子秒表设计中的应用
在电路设计的传统实验过程中，学生大部分时间忙于验证单一的设计，拘限了学生的视野与创新发散思维。将仿真软件Multisim10应用于电路设计的过程，利用仿真软件的优点，给予学生更多的电路设计尝试空间，更多的时间用于设计方法的灵活分析上，这样大大调动学生的动手设计积极性，提高学生动手能力、分析问题和解决问题的能力 ...
可编程逻辑 基于可编程逻辑器件的秒表设计
1/100S计时器常用于比赛中及各种要求较精确的各领域，如果是中小规模集成电路也可以实现这个功能的，但是这个系统的体积较大可操作性差，所以这次使用VHDL语言和硬件相结合制作一个计时器。这样的体积的可以大大缩小的，并且也是可以保证基本功能的前提下可以附加一些额外的功能的，比如系统的复位和指示。
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VIP专区 VIP专区-单片机源代码精选合集系列（17）
eeworm.com VIP专区 单片机源码系列 17资源包含以下内容：1. 基于AVR单片机的智能防火防盗系统设计.zip2. 基于AT89S52可控滚轮的设计与实现.zip3. 基于AVR单片机和CPLD的姿态测试系统设计.zip4. 基于ATMega16L单片机的TCD1208AP线阵CCD接口设计.zip5. 基于AVR系列单片机的多功能信号发生器的设计.zip6. 基于Atmega16单片机 ...
VIP专区 VIP专区-单片机源代码精选合集系列（25）
eeworm.com VIP专区 单片机源码系列 25资源包含以下内容：1. 单片机课件.ppt2. PICC编译器资料.pdf3. stm32初级例程.rar4. 单片机开服各种辅助小工具.zip5. LED旋转灯设计.doc6. 基于51单片机的超温报警器.Zip7. [手把手教你学51单片机与Proteus从入门到精通].59.pdf8. 旋转时钟程序下载.pdf9. 三小时精通protel 99se【单片 ...