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教程资料  ACTEL的FPGA完整开发文挡含测试源码

ACTEL的FPGA完整开发文挡含测试源码

https://www.eeworm.com/dl/fpga/doc/17972.html

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教程资料  TMS3205402Verilog HDL源码

TMS3205402Verilog HDL源码

https://www.eeworm.com/dl/Protel/doc/18021.html

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教程资料  基于FPGA的交通灯的设计有Verilog HDL 源码、仿真图与引脚配置图

基于FPGA的交通灯的设计有Verilog HDL 源码、仿真图与引脚配置图，已下载实现\r\n

https://www.eeworm.com/dl/fpga/doc/18043.html

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教程资料  CRC校验码并行计算的FPGA实现,PDF打开

CRC校验码并行计算的FPGA实现,PDF打开

https://www.eeworm.com/dl/fpga/doc/18052.html

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教程资料  CPLD的CCD采集系统设计源码

实现基于CPLD的CCD采集系统设计源码

https://www.eeworm.com/dl/Protel/doc/18053.html

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教程资料  基于FPGA的多功能数字钟的设计与实现内附有详尽的Verilog HDL源码

基于FPGA的多功能数字钟的设计与实现内附有详尽的Verilog HDL源码，其功能主要有：时间设置，时间显示，跑表，分频，日期设置，日期显示等

https://www.eeworm.com/dl/fpga/doc/18055.html

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教程资料  s3c2410开发板cpld源码

s3c2410开发板cpld源码，希望有些参考价值

https://www.eeworm.com/dl/Protel/doc/18124.html

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教程资料  基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究

针对主控制板上存储器(SRAM) 存储的数据量小和最高频率低的情况,提出了基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究。在实验中,使用了现场可编程门阵列( FPGA) 来实现各模块的逻辑功能。最终实现了对L ED 显示屏的控制,并且一块主控制板最大限度的控制了256 ×128 个像素点,基于相同条件,比静态内存控制的 ...

https://www.eeworm.com/dl/fpga/doc/18155.html

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教程资料  基于CPLD的扰码与解扰码器的设计

基于CPLD的扰码与解扰码器的设计，扰码用M序列实现，m序列级数和频率可选

https://www.eeworm.com/dl/Protel/doc/18173.html

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教程资料  FPGA RSIC CPU设计文档和源码是EDA中对CPU设计非常好用的程序

FPGA RSIC CPU设计文档和源码是EDA中对CPU设计非常好用的程序

https://www.eeworm.com/dl/fpga/doc/18187.html

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