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VHDL/FPGA/Verilog 用NiosII实现的数字钟
用NiosII实现的数字钟,经过本人测试运行正常,开发环境:QuartusII6.0和NiosII IDE6.0
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在matlab环境下实现多普勒频移仿真,采用jakes模型,用于探究多普勒频移对信息传输的影响。
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