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用NiosII实现的数字钟
用NiosII实现的数字钟
VHDL/FPGA/Verilog
371 K
27 次下载
2017-06-08
资源详细信息
文件格式
RAR
文件大小
371 K
资源分类
VHDL/FPGA/Verilog
上传者
lvuxinwu
发布时间
2017-06-08 20:11
下载统计
27
次
所需积分
2 积分
用NiosII实现的数字钟 - 资源详细说明
用NiosII实现的数字钟,经过本人测试运行正常,开发环境:QuartusII6.0和NiosII IDE6.0
用NiosII实现的数字钟 - 源码文件列表
本资源包含 82 个源码文件
支持在线预览,点击文件名即可查看
1
button_pio.v
查看源码
2
cpu_0_ociram_default_contents.mif
查看源码
3
cpu_0_jtag_debug_module.v
查看源码
4
cpu.vo
查看源码
5
lpm_counter0.v
查看源码
6
onchip_ram_4k_test_component.v
查看源码
7
sdram.v
查看源码
8
sdram_test_component.v
查看源码
9
lpm_counter0_waveforms.html
查看源码
10
jtag_uart_0.v
查看源码
11
delay_reset_block.bdf
查看源码
12
sopc_led.qws
查看源码
13
uart.v
查看源码
14
cpu_0_test_bench.v
查看源码
15
onchip_ram_4k.v
查看源码
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