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数字钟的实现
数字钟的实现
VHDL/FPGA/Verilog
1793 K
179 次下载
2015-10-17
资源详细信息
文件格式
RAR
文件大小
1793 K
资源分类
VHDL/FPGA/Verilog
上传者
xushenghao001
发布时间
2015-10-17 00:04
下载统计
179
次
所需积分
2 积分
数字钟的实现 - 资源详细说明
数字钟的实现,由LCD动态显示,VHDL语言实现
数字钟的实现 - 源码文件列表
本资源包含 100 个源码文件
支持在线预览,点击文件名即可查看
1
min.cmd_log
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2
digclk.bgn
查看源码
3
clock.mcs
查看源码
4
s59_tw.vhw
查看源码
5
digclk.ngr
查看源码
6
trce.xmsgs
查看源码
7
ngdbuild.xmsgs
查看源码
8
par.xmsgs
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9
map.xmsgs
查看源码
10
bitgen.xmsgs
查看源码
11
xst.xmsgs
查看源码
12
fpq1s.sym
查看源码
13
pepextractor.prj
查看源码
14
fpq_sound.prj
查看源码
15
digclk.stx
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