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VHDL/FPGA/Verilog ＦＰＧＡ实现全数字锁相环

ＦＰＧＡ实现全数字锁相环，利用硬件描述评议verilog HDL，顶层文件ＤＰＬＬ．Ｖ

https://www.eeworm.com/dl/663/316399.html

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全数字锁相环

软件设计/软件工程  锁相环PLL原理及应用

锁相环PLL原理及应用，请需要的朋友下载

https://www.eeworm.com/dl/684/336588.html

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PLL 锁相环

VHDL/FPGA/Verilog 用FPGA实现数字锁相环

用FPGA实现数字锁相环，开发环境为ISE

https://www.eeworm.com/dl/663/348966.html

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FPGA 数字锁相环

单片机开发  keil51环境开发

keil51环境开发，modbus通讯协议

https://www.eeworm.com/dl/648/349489.html

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keil 51 环境

VHDL/FPGA/Verilog 本人写的数字锁相环

本人写的数字锁相环，有模拟数据，学习锁相环很好的材料。参考书“数字锁相环路原理与应用”编写。

https://www.eeworm.com/dl/663/351752.html

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数字锁相环

邮电通讯系统  VC6.0环境下

VC6.0环境下，编写的七号信令的isup和sccp程序。

https://www.eeworm.com/dl/690/367108.html

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6.0 VC 环境

数学计算  在Visual 2008环境下

在Visual 2008环境下，用C＃编写的一个基本的遗传算法代码。相信对学习遗传算法的人有一定的参考价值。

https://www.eeworm.com/dl/641/386618.html

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Visual 2008 环境

数学计算  在Visual 2008环境下

在Visual 2008环境下，用C＃语言实现的kalman预测算法。对于学习现代信号处理的朋友，有一定的参考价值。

https://www.eeworm.com/dl/641/386619.html

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Visual 2008 环境

汇编语言  约瑟夫环问题：设有编号为1

约瑟夫环问题：设有编号为1，2，3……n的n个人顺时针方向围坐一圈，每人有一密码（正整数）。开始时给出一报数上限m，从编号为1的人开始报数，报m的人出列；以后将出列者的密码作为新的m，从顺时针方向紧挨着他的下一个人开始报数……直至所有人出列。 ...

https://www.eeworm.com/dl/644/388503.html

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其他  joseph环问题的提出与解决

joseph环问题的提出与解决，计算joseph环的最终结果

https://www.eeworm.com/dl/534/411965.html

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数学计算  在Visual 2008环境下

数学计算  在Visual 2008环境下

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