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ＦＰＧＡ实现全数字锁相环

VHDL/FPGA/Verilog 5 K 61 次下载 2014-01-09

资源详细信息

文件格式

RAR

文件大小

5 K

资源分类

VHDL/FPGA/Verilog

上传者

发布时间

2014-01-09 10:41

下载统计

61 次

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2 积分

ＦＰＧＡ实现全数字锁相环 - 资源详细说明

ＦＰＧＡ实现全数字锁相环，利用硬件描述评议verilog HDL，顶层文件ＤＰＬＬ．Ｖ

ＦＰＧＡ实现全数字锁相环 - 源码文件列表

本资源包含 14 个源码文件支持在线预览，点击文件名即可查看

1

divfrequency32_tp.v

2

maichongjiajian.v

3

dpll.v

4

xorphd_tp.v

5

mokcounter_tp.v

6

divfrequency64_tp.v

7

divfrequency32.v

8

divfrequency64.v

9

dpll_tp.v

10

xorphd.v

11

divfrequency8.v

12

mokcounter.v

13

divfrequency8_tp.v

14

maichongjiajian_tp.v

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