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https://www.eeworm.com/dl/648/415892.html 单片机开发

4位数码管显示程序

4位数码管显示程序，动态扫描方式驱动显示
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https://www.eeworm.com/dl/663/419161.html VHDL/FPGA/Verilog

异步置位复位D触发器

异步置位复位D触发器，基于VHDL硬件描述语言的仿真。
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https://www.eeworm.com/dl/519/426692.html 加密解密

128、192、256位AES加解密算法

128、192、256位AES加解密算法
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https://www.eeworm.com/dl/519/427866.html 加密解密

AES 128/256位密钥加密算法

AES 128/256位密钥加密算法，带验证程序，验证通过
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https://www.eeworm.com/dl/663/436447.html VHDL/FPGA/Verilog

高达16位加法器的实现

高达16位加法器的实现，工作环境在ISE，modesim，该例程较为详细！
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https://www.eeworm.com/dl/624/448376.html 串口编程

4位数码显示程序。 静态显示

4位数码显示程序。 静态显示，串入并出。
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https://www.eeworm.com/dl/534/452286.html 其他

22位流水线加法器

22位流水线加法器，altera公司仿真坏境可用。
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https://www.eeworm.com/dl/663/456278.html VHDL/FPGA/Verilog

VHDL实现的8位乘法器

VHDL实现的8位乘法器，所有仿真全部通过
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https://www.eeworm.com/dl/663/456370.html VHDL/FPGA/Verilog

用VHDL语言设计四位全加器

用VHDL语言设计四位全加器，有低位进位和高位进位。
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https://www.eeworm.com/dl/654/457402.html 数据结构

n!不为0的最后一位

n!不为0的最后一位，可以输出千万级别的阶乘最后一位
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