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通讯编程文档 基于MATLAB的2_1_7_维特比译码器的并行算法实现
基于MATLAB的2_1_7_维特比译码器的并行算法实现
matlab例程 Reed Solomon码的编译码器MATLAB仿真程序
Reed Solomon码的编译码器MATLAB仿真程序
VHDL/FPGA/Verilog 38译码器的设计
38译码器的设计，使用vhdl设计译码器，可以下载到开发板上看结果
VHDL/FPGA/Verilog 37个经典的VHDL程序。有比较器、七段译码器、状态机等。
37个经典的VHDL程序。有比较器、七段译码器、状态机等。
VHDL/FPGA/Verilog 用VERILOG语言实现了常用3-8译码器.
用VERILOG语言实现了常用3-8译码器.
数学计算 bch码的编码与译码器实现
bch码的编码与译码器实现，面向对象实现
matlab例程 该程序是RS编译码器的MATLAB仿真程序
该程序是RS编译码器的MATLAB仿真程序，里面有对程序的详细说明和解释。包括编码算法和译法算法的原理，流程以及代码实现。对掌握RS码有非常好的学习价值。
VHDL/FPGA/Verilog 基于VHDL的LS138译码器的实现 一个很简单的程序
基于VHDL的LS138译码器的实现
一个很简单的程序
嵌入式/单片机编程 用硬件描述语言(或混合原理图)设计模24计数器模块、4-7显示译码模块、顶层模块。
用硬件描述语言(或混合原理图)设计模24计数器模块、4-7显示译码模块、顶层模块。