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时钟同步 的查询结果
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单片机开发 程序参考---单片机用时钟芯片sd2300的 读程序
程序参考---单片机用时钟芯片sd2300的 读程序，用c语言写的
DSP编程 1 本程序为DSK板的初始化过程。 2.当DSP的主时钟频率为50MHz时
1 本程序为DSK板的初始化过程。
2.当DSP的主时钟频率为50MHz时，计算锁定时间定时器PLLCOUNT的值，并修改相关程序。
3.将主时钟的频率分别设置为50MHz、20MHz、10MHz、5MHz，通过观察LED指示灯的闪动频率来验证程序运行是否正确。
其他 数字音频广播中的同步算法在pc上的实现 主要运用了导频、最大似然估计等算法结合
数字音频广播中的同步算法在pc上的实现 主要运用了导频、最大似然估计等算法结合
单片机开发 用与对实时时钟芯片ds１３０５进行设定的程序
用与对实时时钟芯片ds１３０５进行设定的程序，为没每１秒开一次
数值算法/人工智能 最近未使用页淘汰（NRU）算法或者时钟算法是实际使用的诸多页淘汰算法中的一种。本课程设计是使用C程序设计语言
最近未使用页淘汰（NRU）算法或者时钟算法是实际使用的诸多页淘汰算法中的一种。本课程设计是使用C程序设计语言，在windows平台下对页淘汰（NRU）算法模拟，通过页淘汰（NRU）算法的模拟来进一步的加深对使用NRU算法的了解，及对C程序设计语言的使用。
关键词：页淘汰 NRU 时钟算法 ...
数学计算 这是用VHDL语言(硬件描述语言)写的一个二维 8*8块的离散余弦变换(DCT)以及反变换(IDCT).全同步设计,低门数.可以用于多媒体及打印应用领域.
这是用VHDL语言(硬件描述语言)写的一个二维
8*8块的离散余弦变换(DCT)以及反变换(IDCT).全同步设计,低门数.可以用于多媒体及打印应用领域.
VHDL/FPGA/Verilog verilog语言写的SPI接口,全同步设计,低门数,可以很容易应用到嵌入设计方案中.
verilog语言写的SPI接口,全同步设计,低门数,可以很容易应用到嵌入设计方案中.
单片机开发 C51 ds12887时钟程序,运行环境为伟福仿真环境
C51 ds12887时钟程序,运行环境为伟福仿真环境
VHDL/FPGA/Verilog 简单的可配置dpll的VHDL代码。 用于时钟恢复后的相位抖动的滤波有很好的效果
简单的可配置dpll的VHDL代码。
用于时钟恢复后的相位抖动的滤波有很好的效果， 而且可以参数化配置pll的级数。