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VHDL/FPGA/Verilog --文件名:mine4.vhd。 --功能:实现4种常见波形正弦、三角、锯齿、方波(A、B)的频率、幅度可控输出(方波 --A的占空比也是可控的)
--文件名:mine4.vhd。
--功能:实现4种常见波形正弦、三角、锯齿、方波(A、B)的频率、幅度可控输出(方波
--A的占空比也是可控的),可以存储任意波形特征数据并能重现该波形,还可完成
--各种波形的线形叠加输出。
--说明: SSS(前三位)和SW信号控制4种常见波形种哪种波形输出。4种波形的频率、
--幅度(基准幅度A)的 ...
VHDL/FPGA/Verilog 实现开漏输出的并口
实现开漏输出的并口,支持3.3V或5V,支持FPGA 的PS 配置功能。8位配置数据
自动移位输出,输入时钟24MHz,产生1MHz配置时钟。8位CPU数据总线接口,
11位地址总线。支持IO 的置位清除功能。
其他书籍 学习javascript的好资料! 第一讲 JavaScript语言概况 第二讲 JavaScript基本数据结构 第三讲 JavaScript程序构成 第四讲 基于对象的J
学习javascript的好资料!
第一讲 JavaScript语言概况
第二讲 JavaScript基本数据结构
第三讲 JavaScript程序构成
第四讲 基于对象的JavaScript语言
第五讲 创建新对象
第六讲 使用内部对象系统
第七讲 窗口及输入输出
第八讲 WEB页面信息交互
第九讲 实现更复杂交互 ...
VHDL/FPGA/Verilog 采用VHDL语言设计一个4通道的数据采集控制模块。系统的功能描述如下: 1.系统主时钟为100 MHz。 2.数据为16位-数据线上连续2次00FF后数据传输开始。 3.系统内部总线宽度为8位。
采用VHDL语言设计一个4通道的数据采集控制模块。系统的功能描述如下:
1.系统主时钟为100 MHz。
2.数据为16位-数据线上连续2次00FF后数据传输开始。
3.系统内部总线宽度为8位。
4.共有4个通道(ch1、ch2、ch3、ch4),每个通道配备100 Bytes的RAM,当存满数据后停止数据采集并且相应通道的状态位产生报警信号。
5.数据分为8 ...
单片机开发 1.生成中英文数字混合的字符串的字模数据. 2.可选择字体
1.生成中英文数字混合的字符串的字模数据.
2.可选择字体,大小,并且可独立调整文字的长和宽,生成任意形状的字符。
3.各种旋转,翻转文字功能
4.任意调整输出点阵大小,并任意调整字符在点阵中的位置。
单片机开发 智能充电器实例 功能:通过定时器定时从AD上读取数据
智能充电器实例
功能:通过定时器定时从AD上读取数据,根据不同的电压选择不同的控制
充电方案,使用PWM控制输出脉宽来控制电流
其他 用vb编辑器读.nrf格式数据
用vb编辑器读.nrf格式数据,并输出至.txt文件
数值算法/人工智能 程序实现的是二层BP网络,通过从文件中读入数据来构建网络,同时读入对应的样本进行学习,测试. ε=0.09 变量为max_error_tollerance forward_pass[
程序实现的是二层BP网络,通过从文件中读入数据来构建网络,同时读入对应的样本进行学习,测试.
ε=0.09 变量为max_error_tollerance
forward_pass[]向前计算输出值
backward_pass[]向后调整权值
数据库系统 成绩数据库管理系统. 1.能够实现菜单显示、菜单选择、编辑(录入、插入、修改、删除等)、查找、显示、求总成绩、按总成绩排序(高→低)并显示、装入数据文件、数据文件存盘、退出、为数据动态分配存储空间[
成绩数据库管理系统.
1.能够实现菜单显示、菜单选择、编辑(录入、插入、修改、删除等)、查找、显示、求总成绩、按总成绩排序(高→低)并显示、装入数据文件、数据文件存盘、退出、为数据动态分配存储空间[10.3.1]等功能。
2.至少分为主、子两个模块,其中主控菜单必须在主模块中。
3.主控程序用CASE结构,显示用宏指 ...
数学计算 这个包里面包含了对Cordic算法的基本函数实现。通过Dformat类来控制系统的数据格式
这个包里面包含了对Cordic算法的基本函数实现。通过Dformat类来控制系统的数据格式,并为Cordic算法类提供辅助。Cordic类为基本函数的计算提供接口。并把仿真所得的数据导入Matlab中进行验证。验证结果用html的形式输出。