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VHDL/FPGA/Verilog CLK 为其时钟脉冲 M 控制工作模式 CO 为允许带进位移位输入 S 控制移位模式0-3 D[7..0]是移位数据输入 QB[7..0]是移位数据输出 CN是移位数

CLK 为其时钟脉冲 M 控制工作模式 CO 为允许带进位移位输入 S 控制移位模式0-3 D[7..0]是移位数据输入 QB[7..0]是移位数据输出 CN是移位数据输出进位

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Delphi控件源码  delphi中把数据输出为html excel等形式的控件

delphi中把数据输出为html excel等形式的控件

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VHDL/FPGA/Verilog 检测输入数据中的“10110”序列

检测输入数据中的“10110”序列，并记录检测到的序列的数目，当序列数目大于15时溢出。输入信号：iclk //输入时钟 rst_ //复位信号 din //输入串行数据输出信号：[3:0] catch //检测到的序列的数目 overflow //数目大于15 ，溢出

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汇编语言  对P1、P2、P3口的输入数据保存

对P1、P2、P3口的输入数据保存，再将这些数据输出给CD显示

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VHDL/FPGA/Verilog ——9999计数器模块　四输出设计要求频率计为四段显示

——9999计数器模块　四输出设计要求频率计为四段显示，故计数器采用0~~9999计数，可以很好的利用数码管，以及增加频率计的精确度。模块内包含俩个进程，一为计数进程，二为时基信号控制计数模块数据输出进程。

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单片机开发  （1）不同情况具有不同的收费标准。 l 白天 l 晚上 l 途中等待（>10min 开始收费）（2）能进行手动修改单价（3）具有数据的复位功能（4） IO 口分配的简易要

（1）不同情况具有不同的收费标准。 l 白天 l 晚上 l 途中等待（>10min 开始收费）（2）能进行手动修改单价（3）具有数据的复位功能（4） IO 口分配的简易要求 l 距离检测使用霍尔开关A44E l 白天/晚上收费标准的转换开关 l 数据的清零开关 l 单价的调整（最好使用&#147 ＋&#148 和&#147 －&#148 按键）（5）数据输 ...

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其他  数码管显示输出

数码管显示输出，七段数码管，并行数据输出，键盘输入信号

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说明：Microchip Technology Inc.采用存储容量为1 Kb至1Mb的低电压串行电可擦除PROM（Electrically Erasable PROM，EEPROM），支持兼容串行外设接口（Serial Peripheral Interface，SPI）的串行总线架构，该系列器件支持字节级和页级功能，存储容量为512 Kb和1Mb的器件还通常与基于闪存的产品结合使用，具有扇区和芯片擦除 ...

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学术论文  基于嵌入式Linux的多媒体播放器设计.rar

随着二十一世纪的到来，人类进入了后PC时代。在这一阶段，嵌入式技术得到了飞速发展和广泛应用。目前，嵌入式技术及其产品已广泛应用于智能家用电器、智能建筑、仪器仪表、通讯产品、工业控制、掌上型电脑、各种智能IC卡的应用等等。将嵌入式系统应用于多媒体移动终端，充分发挥了嵌入式系统的低功耗、集成度高、可扩充能力 ...

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单片机相关  高速AD转换器AD7654与单片机接口电路设计

模／数转换是现代测控电路中非常重要的环节，它有并行和串行两种数据输出形式。目前，模／数转换器ADC已被做成大规模集成电路，并有多种型号和种类可供选择。本文介绍了AD7654的性能特点，并设计了AD76

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