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https://www.eeworm.com/dl/663/212281.html
VHDL/FPGA/Verilog
用VHDL语言实现DDS直接数字频率合成器的设计
用VHDL语言实现DDS直接数字频率合成器的设计，采用正弦RAM表，可实现频率可控的正弦数字信号，编译、仿真通过。
https://www.eeworm.com/dl/532/213447.html
书籍源码
这是在地震勘探数字处理中很重要的一步处理
这是在地震勘探数字处理中很重要的一步处理，及反Q滤波，能够有效补偿信号高频能量，提高地震资料分辨率。本程序包中包括反Q滤波源码和一个实际地震资料的例子，通过例子可以很快的理解并掌握该算法的精髓 ...
https://www.eeworm.com/dl/cadence/ebook/218454.html
电子书籍
dds算发的一些介绍以及几个数字系统的设计
dds算发的一些介绍以及几个数字系统的设计
https://www.eeworm.com/dl/534/218647.html
其他
数字时控器 题目要求： 1、 在定时范围1分钟内
数字时控器
题目要求：
1、 在定时范围1分钟内，用开关设置两个任意时刻t1和t2，到t1时能够自动启动某一过程，t2时停止该过程.
2、 定时精度1s
3、 时间由数码管显示.
4、要求计数器具有异步清零功能，计数控制功能 ...