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通讯编程文档 CDMA通信系统抗多址干扰问题的研究（唐友）。
CDMA通信系统抗多址干扰问题的研究（唐友）。
VHDL/FPGA/Verilog 简单的可配置dpll的VHDL代码。 用于时钟恢复后的相位抖动的滤波有很好的效果
简单的可配置dpll的VHDL代码。
用于时钟恢复后的相位抖动的滤波有很好的效果， 而且可以参数化配置pll的级数。
VHDL/FPGA/Verilog 数字均衡器是通讯信道抗码间干扰的重要环节,这是一个用vhdl写的代码以及用SYNPLIFY8.0综合的RTL电路图 它包含三个模块FILTER,ERR_DECISION,ADJUST 希望对大家有用.
数字均衡器是通讯信道抗码间干扰的重要环节,这是一个用vhdl写的代码以及用SYNPLIFY8.0综合的RTL电路图 它包含三个模块FILTER,ERR_DECISION,ADJUST 希望对大家有用.
matlab例程 短波信道抗多音干扰的性能分析及其仿真
短波信道抗多音干扰的性能分析及其仿真，不用解压密码，直接解压即可。
人物传记/成功经验 模块使用外部滤波器回路来抑制信号抖动和电磁干扰。滤波器回路由PLL接在滤波器输入引脚PLLF和PLLF2之间的电阻Rl和电容Cl、C2组成。电容 Cl、C2必须为无极性电容。在不同的振荡器频率下
模块使用外部滤波器回路来抑制信号抖动和电磁干扰。滤波器回路由PLL接在滤波器输入引脚PLLF和PLLF2之间的电阻Rl和电容Cl、C2组成。电容 Cl、C2必须为无极性电容。在不同的振荡器频率下，R1、Cl、C2的取值不同，常用的参数组合如表l所列。PLL模块的电源引脚PLLVCCA分别通过磁珠和0.1μF的电容与数字电源引脚VDD和数字地引脚V ...
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书籍源码 是通信类的MATLABA仿真抗正弦噪声干扰能力
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VHDL/FPGA/Verilog VHDL 波形防止抖动程序,学习试验材料
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通讯/手机编程 通信原理课程原理课题：数字幅度调制的抗噪声性能。程序运行于MATLAB环境下
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其他书籍 介绍了图像的半影调和抖动技术的原理和数学基础.
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