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抖动 的查询结果
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技术资料 139 264kbt/s相位抖动测试仪 YD/T 503-91
139 264kbt/s相位抖动测试仪：
单片机开发 程序：防止输入抖动程序。 作者：赵相如 语言：C 日期：2009-04-03 联系：zhao-xiangru@163.com 备注：注意：对单片机的输入点都要求有防止抖动程序。 -----
程序：防止输入抖动程序。
作者：赵相如
语言：C
日期：2009-04-03
联系：zhao-xiangru@163.com
备注：注意：对单片机的输入点都要求有防止抖动程序。
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程序介绍：
K1、K2为按钮，OUT为输出灯。
按下k1，经过延时子程序，判断是否抖动，
灯OUT点亮。
按下K2，经过延时子 ...
VHDL/FPGA/Verilog Clock_Dithering_Verilog this is a Clock u_dither, 大家想要做Verilog去抖动的可以参考.
Clock_Dithering_Verilog this is a Clock u_dither, 大家想要做Verilog去抖动的可以参考.
通讯/手机编程 类似QQ抖动一样,在屏幕上抖几抖,非常使用,欢迎大家试用
类似QQ抖动一样,在屏幕上抖几抖,非常使用,欢迎大家试用
其他嵌入式/单片机内容 P18F4610的信号采集及抗抖动程序．MCC18编译器．
P18F4610的信号采集及抗抖动程序．MCC18编译器．
技术资料 关于1400冷轧机液压自动辊缝控制系统抖动一例的分析
文章主要就1400 冷轧机液压自动辊缝控制(AGC) 系统抖动的处理过程作一介绍,并就抖动的原因进行系统的分析,为诊断液压AGC 系统的抖动找出理论根据,供参考。关键词:冷轧机;液压AG
技术资料 循环过滤器配置为MAX3670低抖动PLL频率参考时钟发生器
Abstract: The MAX3670 low-jitter clock generator is a monolithic phase-locked loop (PLL) that uses a
VHDL/FPGA/Verilog 简单的可配置dpll的VHDL代码。 用于时钟恢复后的相位抖动的滤波有很好的效果
简单的可配置dpll的VHDL代码。
用于时钟恢复后的相位抖动的滤波有很好的效果， 而且可以参数化配置pll的级数。
嵌入式/单片机编程 键盘去抖动CPLD设计经过验证,可以直接用数码管显示,同时也希望大家给于新想法
键盘去抖动CPLD设计经过验证,可以直接用数码管显示,同时也希望大家给于新想法
VHDL/FPGA/Verilog 防抖电路设计,采用计数器内部及时,科以有效防止按键抖动带来的错误操作
防抖电路设计,采用计数器内部及时,科以有效防止按键抖动带来的错误操作