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抖动 的查询结果
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VHDL/FPGA/Verilog 可以用于按键去抖动的电路应用
可以用于按键去抖动的电路应用，采用vhdl编写
VHDL/FPGA/Verilog 本程序有效的防止了按键的抖动
本程序有效的防止了按键的抖动，可以移植于各种需要按键防抖的程序，本程序是功能为按键防抖16进制减法计数器
VHDL/FPGA/Verilog 本程序有效的防止了按键的抖动
本程序有效的防止了按键的抖动，可以移植于各种需要按键防抖的程序，本程序是功能为按键防抖16进制减法计数器
技术资料 高速串行Serdes信号的眼图抖动测试
随着新研发单板上高速Serdes信号的增多，信号完整性测试显的越来越重要，本文档围绕Serdes信号的眼图抖动测试总结一些测试注意事项。新研发单板上高速Serdes信号速率高达2.45G，一些时钟信号上升/下降沿达到400ps左右，必然需要测量Serdes信号的眼图、抖动，在这里总结一些测试经验和注意事项。UBPG1单板上有如下几种高速数 ...
技术资料 51单片机独立按键去抖动程序
该文档为51单片机独立按键去抖动程序讲解文档，是一份还算不错的参考文档，感兴趣的可以下载看看，，，，，，，，，，，，，，，，，
技术资料 按键防抖动51汇编程序.txt
资料->【C】嵌入系统->【C0】嵌入式综合->【2】单片机编程->【参考程序】->按键防抖动51汇编程序.txt
技术资料 用于高速AD的低抖动时钟稳定电路
介绍了一种用于高速ADC 的低抖动时钟稳定电路。这个电路由延迟锁相环(DLL)来实现。这个DLL 有两个功能：一是通过把一个时钟沿固定精确延迟半个周期，再与另一个沿组成一个新的时钟来调节时钟占
技术资料 抖动对点目标检测性能影响的分析
红外—光学图像检测跟踪系统中，为了提高信噪比和检测概率常常需要进行多帧信号累积。现有关于能量累积的理论和算法建立在多帧图像中目标在位置上相互对准的假定之下。然而，在点目标情况下，多帧点目标位置相互对准
技术资料 利用频域时钟抖动分析加快设计验证过程
随着数据速率的提高，时钟抖动分析的需求也在与日俱增。在高速串行数据链路中，时钟抖动会影响发射机、传输线和接收机的数据抖动。保证时钟质量的测量也在不断发展。目前的重点是针对比特误码率，在时钟性能和系统性
技术资料 时钟抖动时域分析第3部分
时钟抖动时域分析第3部分，欢迎大家一起讨论电子方面知识。