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技术资料  VerilogHDL那些事儿——整合篇

笔者详细的谈论许多在整合里会出现的微妙思路，如：如何把计数器/定时器整合在某个步骤里，从何提升模块解读性和扩展性。此外，在整合篇还有一个重要的讨论，那就是 for，while 和 do ... while 等循环。这些都是一些顺序语言的佼佼者，可是在 Verilog HDL 语言里它们就黯然失色。整合篇所讨论的内容不单是循环而已，整合篇 ...

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verilogl

技术资料  一种基于高速超微型单片机的CCD驱动电路设计

CCD作为一种光电转换器件，由于其具有精度高、分辨率好、性能稳定等特点，目前广泛应用于图像传感和非接触式测量领域。在CCD应用技术中，最关键的两个问题是CCD驱动时序的产生和CCD输出信号的处理。对于CCD输出信号，可以根据CCD像素频率和输出信号幅值来选择合适的片外或片内模数转换器；而对于CCD驱动时序，则有几类常用 ...

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单片机 ccd 驱动电路

技术资料  FPGA核心知识详解与开发技巧-完整版.docx

FPGA核心知识详解与开发技巧对初级FPGA工程师而言，必须掌握FPGA相关基础知识、精通硬件描述语言、熟练数字电路设计、加强工程项目的实践。应广大初级FPGA工程师/FPGA爱好者之需，电子发烧友网策划整合并隆重推出FPGA核心知识详解与开发技巧电子书，以后会陆续推出其他章节，敬请广大工程师朋友继续关注和留意。目录1、FPGA ...

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fpga

单片机编程  HM62256详细资料

HM62256为8位高速静态RAM（SRAM），文件包括HM62256详细介绍以及其封装类型尺寸，引脚功能和内部时序电路

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62256 HM

VHDL/FPGA/Verilog 一些简单的VHDL实例

一些简单的VHDL实例，主要是介绍一些基本逻辑们及一些组合、时序电路的例子，供大家参考

https://www.eeworm.com/dl/663/231617.html

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VHDL

VHDL/FPGA/Verilog CPU设计中的controlunit源码

CPU设计中的controlunit源码，其中附带了时序仿真。通过Sequencing Logic 产生 control_signals,具体的信号可在controlsignal.mif文件中直接修改。

https://www.eeworm.com/dl/663/300195.html

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controlunit CPU 源码

技术资料  ds18b20

ds18b20对时序的要求很高，时钟要选8M以上的。单片机用的是ATMEGA88PA

https://www.eeworm.com/dl/982002.html

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ds

技术资料  MIPI转LVDS

覆盖MIPI到LVDS协议转换的完整技术方案，涵盖信号解析、时序控制及硬件实现细节，适用于显示接口开发与调试场景。

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MIPI LVDS 接口转换显示协议

技术资料  多周期

涵盖多周期设计的完整Verilog实现，深入讲解时序控制与状态机逻辑，适用于数字电路开发与系统级设计实践。

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Verilog 多周期设计时序控制状态机

电源技术  基于交交变频的静止进相器研究

阐述了异步电动机无功补偿的原理,提出了通过交交变频实现异步电动机无功功率补偿的方法。系统采用单片机控制,能够实现自动跟踪、自动补偿以达到提高电动机功率因数、降低电机定子电流、电机温升等目的。

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交交变频静止进相器

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