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单片机开发 18B20和单总线的时序及其工作原理,51单片机控制的18B20程序(包括多个18B20的程序)18B20 and single-bus timing and its working principl
18B20和单总线的时序及其工作原理,51单片机控制的18B20程序(包括多个18B20的程序)18B20 and single-bus timing and its working principle, control of 51 single-chip 18B20 procedures (including procedures for more than 18B20)
汇编语言 《三相交流异步电动机SVPWM开环调速控制程序（软件法）》 .include "240x.h" 寄存器地址 .global _c_int0 全局化标号
《三相交流异步电动机SVPWM开环调速控制程序（软件法）》
.include "240x.h" 寄存器地址
.global _c_int0 全局化标号
技术资料 D触发器verilog
带异步清零，异步置数的D触发器
Internet/网络编程 Socketlib: 一个轻量级的C++ 封装Socket C API 网络编程框架。 它简化了Socket异步事件分派、进程间Socket通信的并发OO网络应用和服务的开发。 目前
Socketlib: 一个轻量级的C++ 封装Socket C API 网络编程框架。
它简化了Socket异步事件分派、进程间Socket通信的并发OO网络应用和服务的开发。
目前，只支持Window下IPV4；将来支持IPV6，并希望能将其扩展到linux/unix等OS平台。
单片机开发 DAC1230是一个12位的模数转换的芯片!而使用时候是在8位的单片机上运行,所以需要注意高四位和低八位的写入时序
DAC1230是一个12位的模数转换的芯片!而使用时候是在8位的单片机上运行,所以需要注意高四位和低八位的写入时序
VHDL/FPGA/Verilog FSCQ1565RP J TAG驱动算法是MCU 以J TAG模式配置FPGA 的关 键。算法调用SVF 配置文件,解释其中的语法规范,生成严 格的TAP 总线时序,驱动MCU 的通用I/ O
FSCQ1565RP
J TAG驱动算法是MCU 以J TAG模式配置FPGA 的关
键。算法调用SVF 配置文件,解释其中的语法规范,生成严
格的TAP 总线时序,驱动MCU 的通用I/ O 管脚来完成对
FPGA 的配置。其中TAP 时序是算法设计和实现调试的一
个主要方面,时序关系[ 2 ]如图3 所示。 ...
文章/文档 介绍了IIR 滤波器的FPGA 实现方法,给出了 IIR 数字滤波器的时序控制、延时、补码乘法和累加四个模块的设计方法,并用VHDL和FPGA 器件实现了IIR 数字滤波。
介绍了IIR 滤波器的FPGA 实现方法,给出了 IIR 数字滤波器的时序控制、延时、补码乘法和累加四个模块的设计方法,并用VHDL和FPGA 器件实现了IIR 数字滤波。
单片机编程 VESA标准 04版
VESA时序标准，显示器时序标准，Version1.0
技术资料 2017年数字IC设计工程师招聘面试笔试100题附答案
1：什么是同步逻辑和异步逻辑？ 同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系。 同步时序逻辑电路的特点：各触发器的时钟端全部连接在一起，并接在系统时钟端，只有当时钟脉冲到来时，电路的状态才能改变。改变后的状态将一直保持到下一个时钟脉冲的到来，此时无论外部输入 x 有无变 ...
软件设计/软件工程 关于C#中委托、接口的一种理解方式。 将紧耦合、异步通知、静态监听者等融合进一个代码故事增强其可理解性。 适合CSharp学习者阅读
关于C#中委托、接口的一种理解方式。
将紧耦合、异步通知、静态监听者等融合进一个代码故事增强其可理解性。
适合CSharp学习者阅读