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系统设计方案 太原理工大学硕 士 学 位 论 文 摘 要 网络缓存(Web Caching)把经常访问的网络对象在访问开 销较少的网络节点上存一个副本
太原理工大学硕 士 学 位 论 文 摘 要 网络缓存(Web Caching)把经常访问的网络对象在访问开 销较少的网络节点上存一个副本,当用户再次访问这些对象时, 可以直接从这个开销较少的网络节点上得到满足。从而在有限 的带宽内,达到缩短用户等待时间、提高网络性能和网络可扩 展性的目的,对于提高Internet 访问效率具有重要 ...
Java书籍 JAVA CARD 开发包
JAVA CARD 开发包,对于 java card开发的 初学者来说,很有用;下再回去好好研究一下 和j2sdk1.4.2_06配合用
Java书籍 这是STRUTS1.2。6的开发包。。这是我从芝APACHE网站下下来
这是STRUTS1.2。6的开发包。。这是我从芝APACHE网站下下来
Java书籍 PDF格式的JDBC3.0开发文档
PDF格式的JDBC3.0开发文档,有助于对JDBC的学习和开发
VHDL/FPGA/Verilog PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿
PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上;顶层文件是PLL.GDF
数据结构 单循环存储结构实现约瑟夫环,n个人从1到n编码,然后围坐一圈,每人持有一密码
单循环存储结构实现约瑟夫环,n个人从1到n编码,然后围坐一圈,每人持有一密码
微处理器开发 三星ARM9芯片s3c2440的wince4.2BSP开发包
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VHDL/FPGA/Verilog 用VHDL写的数字锁相环程序 pll.vhd为源文件 pllTB.vhd为testbench
用VHDL写的数字锁相环程序 pll.vhd为源文件 pllTB.vhd为testbench
网络 LINUX平台下扫描开了匿名FTP服务的主机主机.
LINUX平台下扫描开了匿名FTP服务的主机主机.
人工智能/神经网络 C4.5算法进行决策树生成 以信息增益最大的属性作为分类属性
C4.5算法进行决策树生成 以信息增益最大的属性作为分类属性,生成决策树,从而得出决策规则。