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差分电路 的查询结果
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文件格式 课程设计,数字钟的电子技术课程设计.数字钟是一种用数字电路技术实现时、分、秒计时的装置
课程设计,数字钟的电子技术课程设计.数字钟是一种用数字电路技术实现时、分、秒计时的装置，与机械式时钟相比具有更高的准确性和直观性，且无机械装置，具有更更长的使用寿命，因此得到了广泛的使用。
单片机开发 数字时钟 时钟能够显示分、秒； 电路具有可调时功能； 电路具有声音报时功能； 时间能够显示时； 提高时钟准确度。
数字时钟
时钟能够显示分、秒；
电路具有可调时功能；
电路具有声音报时功能；
时间能够显示时；
提高时钟准确度。
VHDL/FPGA/Verilog 用VHDL硬件描述语言实现的良好运行的三分频电路
用VHDL硬件描述语言实现的良好运行的三分频电路
单片机开发 差动电容传感器信号处理电路
差动电容传感器信号处理电路，一份从维普上花钱下载来的文章。研究传感器电路设计的朋友可以参考一下的。
VHDL/FPGA/Verilog 分频电路的VHDL设计,在你的设计中,如果有用到分频电路的话,他将帮组你了解分频电路
分频电路的VHDL设计,在你的设计中,如果有用到分频电路的话,他将帮组你了解分频电路
VHDL/FPGA/Verilog VHDL实现倍频--偶数倍 分频电路 --分频倍数=2（n+1）
VHDL实现倍频--偶数倍 分频电路
--分频倍数=2（n+1）
VHDL/FPGA/Verilog 有实验结果,用MOSIN6编写的,是Verilog HDL语言实现的. 练习三 利用条件语句实现计数分频时序电路 实验目的： 1. 掌握条件语句在简单时序模块设计中的使用； 2. 学习在Ver
有实验结果,用MOSIN6编写的,是Verilog HDL语言实现的.
练习三 利用条件语句实现计数分频时序电路
实验目的：
1. 掌握条件语句在简单时序模块设计中的使用；
2. 学习在Verilog模块中应用计数器；
3. 学习测试模块的编写、综合和不同层次的仿真。
练习四 阻塞赋值与非阻塞赋值的区别
实验目的：
1． 通过实验，掌握阻塞赋值与 ...
VHDL/FPGA/Verilog 利用数控分频器设计硬件电子琴.硬件电子琴电路模块设计
利用数控分频器设计硬件电子琴.硬件电子琴电路模块设计
VHDL/FPGA/Verilog 1 8位加法器的设计 2 分频电路 3 数字秒表的设计
1 8位加法器的设计
2 分频电路
3 数字秒表的设计