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教程资料  相关于fpga的vga显示的控制

相关于fpga的vga显示的控制，包括模块，设计思路，方案等重要代码

https://www.eeworm.com/dl/fpga/doc/17745.html

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教程资料  应用VHDL技术设计嵌入式全数字锁相环路的方法

介绍了应用VHDL技术设计嵌入式全数字锁相环路的方法，详细叙述了其工作原理和设计思想，并用可编程逻辑器件FPGA实现。

https://www.eeworm.com/dl/fpga/doc/17765.html

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教程资料  基于FPGA的全数字锁相环设计

基于FPGA的全数字锁相环设计,内有设计过程和设计思想

https://www.eeworm.com/dl/fpga/doc/17864.html

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教程资料  verilog编写基于fpga的鉴相器模块

verilog编写基于fpga的鉴相器模块

https://www.eeworm.com/dl/fpga/doc/18078.html

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教程资料  基于FPGA设计数字锁相环

基于FPGA设计数字锁相环，提出了一种由微分超前/滞后型检相器构成数字锁相环的Verilog-HDL建模方案

https://www.eeworm.com/dl/fpga/doc/18093.html

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教程资料  高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题

针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的\r\n新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电路来实现。最后利\r\n用仿真波形验证该设计的合理性和有效性。整个设计负载范围宽、锁相时间短,现已成功应用于100 kHz/ 30 k ...

https://www.eeworm.com/dl/fpga/doc/18237.html

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教程资料  关于数字锁相环的一点东西

关于数字锁相环的一点东西,可以下来看看\r\n

https://www.eeworm.com/dl/fpga/doc/18354.html

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教程资料  Verilog实现的DDS正弦信号发生器和测频测相模块

Verilog实现的DDS正弦信号发生器和测频测相模块，DDS模块可产生两路频率和相位差均可预置调整的值正弦波，频率范围为20Hz-5MHz，相位范围为0°-359°，测量的数据通过引脚传输给单片机，单片机进行计算和显示。

https://www.eeworm.com/dl/fpga/doc/18425.html

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教程资料  本教程定位于FPGA/CPLD的快速入门。以ALTERA公司的芯片和相应的开发软件为目标载体进行阐述

本教程定位于FPGA/CPLD的快速入门。以ALTERA公司的芯片和相应的开发软件为目标载体进行阐述，本教程阐述了ALTERA主要系列芯片PLD芯片的结构和特点以及相应的开发软件MAX和Plusa和Quartus的使用

https://www.eeworm.com/dl/fpga/doc/18739.html

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技术书籍  基于参数自整定的沥青洒布量控制

　　根据比例因子与系统性能的关系和整定原则，得到可行的整定规则表，对沥青撒布控制系统采用了参数自整定模糊控制算法控制喷洒的压力，实现了洒布量的稳定精确控制，提高了洒布质量和生产效率。

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