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VHDL/FPGA/Verilog 基于地址总线接口的四倍频编码器信号接口的 FPGA实现 Verilog HDL的

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单片机开发 单片机的四位显示及时间.单片机上电复位后,等待按键4启动定时器0 再次按键4,定时器0停止计数,进入时分初值设置状态,每按一次1键,时加一,每按一次2键,分加一

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https://www.eeworm.com/dl/648/160558.html
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人工智能/神经网络 多个感知器神经元的分类问题 %四类输入向量

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人工智能/神经网络 感知器神经网络设计举例:将四个输入矢量分为两类

感知器神经网络设计举例:将四个输入矢量分为两类,其中两个矢量对应的目标值为1,另两个矢量对应的目标值为0,用学习函数求解.
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VHDL/FPGA/Verilog 四位全家器的VHDL语言模块

四位全家器的VHDL语言模块,已经在ISE8.1上经过测试通过
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DSP编程 TMS320C54X DSP 实验指导程序 实验一 常用指令实验 实验二 数据存储实验 实验三 I/O实验 实验四 定时器实验 实验五 INT2中断实验 实验六 A/D转换实验 实验七

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VC书籍 MS VC++6.0 程序员指南 第一部分:基础知识 第二部分:编辑器 第三部分:编程指南 第四部分:ActiveX控件 第五部分:高级主题 第六部分:附录

MS VC++6.0 程序员指南 第一部分:基础知识 第二部分:编辑器 第三部分:编程指南 第四部分:ActiveX控件 第五部分:高级主题 第六部分:附录
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汇编语言 PIC12F629写的另一个LED变化程序(慢慢从暗到最亮,用时三秒-->维持最亮四秒-->慢慢从最亮变暗,用时三秒-->维持暗灭两秒, 周而复始.

PIC12F629写的另一个LED变化程序(慢慢从暗到最亮,用时三秒-->维持最亮四秒-->慢慢从最亮变暗,用时三秒-->维持暗灭两秒, 周而复始.
https://www.eeworm.com/dl/644/176824.html
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VHDL/FPGA/Verilog 这是我最近买的一套CPLD开发板VHDL源程序并附上开发板的原理图,希望对你是一个很好的帮助!其中内容为:8位优先编码器,乘法器,多路选择器,二进制转BCD码,加法器,减法器,简单状态机,四位比较器,

这是我最近买的一套CPLD开发板VHDL源程序并附上开发板的原理图,希望对你是一个很好的帮助!其中内容为:8位优先编码器,乘法器,多路选择器,二进制转BCD码,加法器,减法器,简单状态机,四位比较器,7段数码管,i2c总线,lcd液晶显示,拨码开关,串口,蜂鸣器,矩阵键盘,跑马灯,交通灯,数字时钟. ...
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