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压缩解压 利用一块芯片完成除时钟源、按键、扬声器和显示器(数码管)之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短(设计过程中即可实现时序仿真)、调试
利用一块芯片完成除时钟源、按键、扬声器和显示器(数码管)之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短(设计过程中即可实现时序仿真)、调试方便、故障率低、修改升级容易等特点。
本设计采用自顶向下、混合输入方式(原理图输入—顶层文件连接和VHDL语言输 ...
VHDL/FPGA/Verilog 1.设计目的 (1)设计交通灯控制器; (2)学习状态机的设计方法; (3)学习原理图、状态机等多种的设计方法进行混合设计; (4)熟练掌握器件设计输入、编译、仿真和编程的过程。 2.设计内
1.设计目的
(1)设计交通灯控制器;
(2)学习状态机的设计方法;
(3)学习原理图、状态机等多种的设计方法进行混合设计;
(4)熟练掌握器件设计输入、编译、仿真和编程的过程。
2.设计内容
位于十字路口的交通灯,在A方向和B方向各有红、黄、绿三盏灯,按所列顺序进行循环,交通灯循环顺序见表1所示。其中1表示 ...
其他嵌入式/单片机内容 开发平台为ADS1.2。为ARM器件的计算机仿真
开发平台为ADS1.2。为ARM器件的计算机仿真,仿真内容是按键对ARM的控制
其他嵌入式/单片机内容 开发平台为ADS1.2。为ARM器件的计算机仿真
开发平台为ADS1.2。为ARM器件的计算机仿真,仿真内容是ARM对LED的控制
嵌入式/单片机编程 利用一块芯片完成除时钟源、按键、扬声器和显示器(数码管)之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短(设计过程中即可实现时序仿真)、调试
利用一块芯片完成除时钟源、按键、扬声器和显示器(数码管)之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短(设计过程中即可实现时序仿真)、调试方便、故障率低、修改升级容易等特点 ...
其他 电路仿真器件模型,型号齐全
电路仿真器件模型,型号齐全,经验证可靠、实用。
技术资料 基于Comsol电磁器件的设计与仿真
人工电磁材料由于其特殊的电磁特性,一直是近几年的研究热点。美国Science杂志更将这种材料评为2003年世界十大突破之一。随着科技和生产技术的提高,电磁材料被应用于各式各样的电磁器件当中,推动了电磁器件的发展。本文主要运用现有的有限元仿真软件Comsol,成功设计和仿真了多种电磁器件,讨论了电磁材料的电磁特性参数 ...
学术论文 基于DSP的IGBT励磁系统研究与仿真.rar
励磁调节系统是同步发电机的重要组成部分,对同步发电机乃至电力系统的安全稳定运行有着重要影响。随着电力系统规模的不断增大,系统结构和运行方式日趋复杂,对同步发电机励磁控制系统运行的可靠性、稳定性、经济性和灵活性提出了更高的要求。本文根据励磁调节器的国内外发展趋势,研究开发了以TMS320F2812芯片为控制核心 ...
学术论文 基于FPGA/CPLD实现的FFT算法与仿真分析
可编程逻辑器件FPGA(现场可编程门阵列)和CPLD(复杂可编程逻辑器件)越来越多的应用于数字信号处理领域,与传统的ASIC(专用集成电路)和DSP(数字信号处理器)相比,基于FPGA和CPLD实现的数字信号处理系统具有更高的实时性和可嵌入性,能够方便地实现系统的集成与功能扩展。 FFT的硬件结构主要包括蝶形处理器、存储单元、地址生 ...
学术论文 嵌入式USB总线器件端处理器的FPGA实现研究
本文提出了一种适合于嵌入式SoC的USB器件端处理器的硬件实现结构。并主要研究了USB器件端处理器的RTL级实现及FPGA原型验证、和ASIC实现研究,包括从模型建立、算法仿真、各个模块的RTL级设计及仿真、FPGA的下载测试和ASIC的综合分析。它的速度满足预定的48MHz,等效门面积不超过1万门,完全可应用于SOC设计中。 本文 ...