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教程资料 基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码

基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码，其功能主要有：时间设置，时间显示，跑表，分频，日期设置，日期显示等
https://www.eeworm.com/dl/fpga/doc/18055.html
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教程资料 FPGA设计常用资料大全

FPGA设计常用资料大全，内含一些代码，还算比较全吧
https://www.eeworm.com/dl/fpga/doc/18066.html
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教程资料 有时间显示与设置、秒表、闹钟、日期显示与设置功能

有时间显示与设置、秒表、闹钟、日期显示与设置功能，用6个数码管显示。
https://www.eeworm.com/dl/fpga/doc/18132.html
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教程资料 fpga功能实现有限字长响应FIR

fpga功能实现有限字长响应FIR，用verilog编写
https://www.eeworm.com/dl/fpga/doc/18310.html
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教程资料 COOLRUNNER系列CPLD的结构,特点及功能

本文详细分析了COOLRUNNER系列CPLD的结构,特点及功能,使用VHDL语言实现数字逻辑,实现了水下冲击波记录仪电路的数字电路部分.
https://www.eeworm.com/dl/Protel/doc/18330.html
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教程资料 自己设计的Smartcard功能模块

自己设计的Smartcard功能模块，已经通过vcs仿真和FPGA验证，可以使用。
https://www.eeworm.com/dl/fpga/doc/18348.html
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教程资料 实现由ARM2410本身配置fpga的功能

实现由ARM2410本身配置fpga的功能\r\nfpga型号是ECP35和1K50/1C6
https://www.eeworm.com/dl/fpga/doc/18409.html
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教程资料 50个各种不同功能的CPLD程序例子

50个各种不同功能的CPLD程序例子，拿来就可以用，每个都经过了综合测试，非常实用
https://www.eeworm.com/dl/Protel/doc/18438.html
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教程资料 CPLD设计实现智能机器小车主要完成寻迹功能等

智能机器小车主要完成寻迹功能，由机械结构和控制单元两个部分组成。机械结构是一个由底盘、前后辅助轮、控制板支架、传感器支架、左右驱动轮、步进电机等组成。控制单元部分主要由主要包含传感器及其调理电路、步进电机及驱动电路、控制器三个部分。本设计的核心为控制器部分，采用Altera MAX7000S系列的EPM7064LC84-15作 ...
https://www.eeworm.com/dl/Protel/doc/18480.html
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教程资料 基于CPLD的多功能信号发生器设计

基于CPLD的多功能信号发生器设计.PDF
https://www.eeworm.com/dl/Protel/doc/18600.html
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