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https://www.eeworm.com/dl/663/435741.html VHDL/FPGA/Verilog

实现任意奇数偶数分频的 模块

实现任意奇数偶数分频的 模块 ，而且占空比为50 ，本人一直在用，很好用！
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https://www.eeworm.com/dl/663/446885.html VHDL/FPGA/Verilog

半整数分频器的实现（verilog）

半整数分频器的实现（verilog），本文以6.5分频为例！很实用的！
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https://www.eeworm.com/dl/663/465285.html VHDL/FPGA/Verilog

用FPGA仿真实现数控分频器

用FPGA仿真实现数控分频器，完整的工程文件
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https://www.eeworm.com/dl/869707.html 技术资料

stm32分频红外测距代码

基于stm32开发板的单片机定时器编程与机器人距离的检测函数，建议用keil打开
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https://www.eeworm.com/dl/902543.html 技术资料

二分频器LC公式

音箱分频器制作，有用的得上的就下吧，很实用
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https://www.eeworm.com/dl/905536.html 技术资料

数控分频器及其应用VHDL源代码

本设计以8位可并行预置的分频器为模块，设计出PWM及征服脉冲宽度由两个8位输入数据控制的方波发生器。开发环境为Quartus II 9.0。
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https://www.eeworm.com/dl/974391.html 技术资料

时钟分频器clk2scl.rar

时钟分频器clk2scl.rar，很简单，很明了，看看就知道！
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https://www.eeworm.com/dl/644/222127.html 汇编语言

一个好用的整数分频电路 保证你喜欢 能够实现对任意整数的分频电路设计

一个好用的整数分频电路 保证你喜欢 能够实现对任意整数的分频电路设计
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https://www.eeworm.com/dl/663/353705.html VHDL/FPGA/Verilog

数控分频器的设计数控分频器的功能就是当在输入端给定不同输入数据时

数控分频器的设计数控分频器的功能就是当在输入端给定不同输入数据时，将对输入的时钟信号有不同的分频比，数控分频器就是用计数值可并行预置的加法计数器设计完成的，方法是将计数溢出位与预置数加载输入信号相接即可。 ...
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https://www.eeworm.com/dl/648/227086.html 单片机开发

本文介绍了两种分频系数为整数或半整数的可控分频器的设计方法。其中之一可以实现50％的奇数分频。利用VHDL语言编程

本文介绍了两种分频系数为整数或半整数的可控分频器的设计方法。其中之一可以实现50％的奇数分频。利用VHDL语言编程，并用QUARTERS||4.0进行仿真，用 FPGA 芯片实现。 关键词：半整数，可控分频器，VHDL, FPGA
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