搜索：光子计数
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https://www.eeworm.com/dl/663/372157.html
VHDL/FPGA/Verilog
计数器的FPGA控制程序
计数器的FPGA控制程序，开发平台为ISE或者quartus
https://www.eeworm.com/dl/663/410832.html
VHDL/FPGA/Verilog
FIFO和计数器以及时钟控制
FIFO和计数器以及时钟控制，用于程控交换机教学，与DSP和ADDA芯片配合完成程控交换机功能
https://www.eeworm.com/dl/663/483393.html
VHDL/FPGA/Verilog
（1） 计数器的输入为RST（复位）
（1） 计数器的输入为RST（复位），EN（使能），CLK（时钟），U_D（up_down加/减选择）；输出为COUT（进位/借位输出），CQ（3：1）（数值输出）；
范围65536。