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VHDL/FPGA/Verilog 数字琐相环DPLL的VERLOG代码
数字琐相环DPLL的VERLOG代码，MODELSIM下的工程，有测试文件
加密解密 VC6.0环境下开发
VC6.0环境下开发，具备简单的加密和解密功能
单片机开发 pll锁向环控制程序
pll锁向环控制程序，让你进入无线控制领域，采用ts9256作例子，有工程文件直接用keil c打开。
游戏 在2005环境下开发的
在2005环境下开发的，用于读取DirectX的文件格式*.x，可以批量读取，并可用键盘操作模型。
VC书籍 解释vc6.0环境下
解释vc6.0环境下，如何彻底删除一个类
其他 在vc++6.0环境下
在vc++6.0环境下，对验证网络IP地址的演示程序，很实用，给大家一起分享！
其他 在vc++6.0环境中
在vc++6.0环境中，对位图的显示处理程序源代码。该程序实现了简单的位图加载处理，已经通过调试，放心使用！
系统设计方案 基于FPGA设计数字锁相环
基于FPGA设计数字锁相环，提出了一种由微分超前/滞后型检相器构成数字锁相环的Verilog-HDL建模方案
数据结构 数据结构约瑟夫环实验报告
数据结构约瑟夫环实验报告，包括源程序，完整版本，经测试，运行正常
VHDL/FPGA/Verilog 锁相环的仿真以及含有文本
锁相环的仿真以及含有文本，希望能有帮助。锁相环对通信中还是很重要的