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8位相等比较器含源代码，用VHDL语言编写，具体很高的实用性，供读者参考
2017-08-21 00:51:02
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2,1,7卷积码的viterbi译码算法的FPGA实现,使用vhdl语言编写，内容详细,而且附带源代码
2022-11-05 08:50:02
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对FPGA的验证有进一步的了解，适合有一定VHDL语言基础的技术人员
2024-03-19 10:20:01
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资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDLcksc.pdf
2024-06-17 19:30:01
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资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->AHDL.zip
2024-07-23 05:30:01
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资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDLsDecodersSkeleton.pdf
2024-11-05 16:50:01
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电子琴VHDL程序包含有：顶层程序、音阶发生器程序、数控分频模块程序和自动演奏模块程序。
2024-12-20 08:30:02
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资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->HDL.rar
2025-01-09 00:00:01
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基于VHDL的音频信号分析器的设计,4通道复用,可分析正弦信号失真度
2025-11-16 05:25:56
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所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点。
2014-01-02 06:20:09
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所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点
2013-12-26 00:13:07
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采用VHDL语言设计一个4通道的数据采集控制模块。系统的功能描述如下：
1.系统主时钟为100 MHz。
2.数据为16位-数据线上连续2次00FF后数据传输开始。
2013-12-25 03:13:01
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首先采用LPM_ROM和
VHDL选择语句这两种方法进行波形存储表的设计和比较分析 然后考虑到硬件资源的有限性及DDS的精度要
求,对这两种方法的程序进行了优化 最后对这两种方法设计的程序进行仿真和硬件调试
2017-09-16 00:21:02
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Window应用问答
Linux 使用小技巧
Linux 指令大全
LINUX 文件系统介绍
Linux 系统设定
Linux 系统命令
Linux的安装
Linux的快技法
Linux是什么
2017-04-27 10:41:02
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传感器到底是什么呢?其实它就相当于我们的眼、耳、鼻、舌和身体等5个感觉器官。在汽车上人们利用传感器来取代人体的5个感觉器官，以减轻
2024-03-01 15:00:01
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这是我毕业设计做的一个SVPWM同步永磁交流电机的控制系统，里面除了一个SVPWM的驱动算法之外，还有一个步进电机的控制器，以及基于QUARTUS7.2的NIOS II控制核心，通过PC的串口可以控制同步永磁交流电机和步进电机进行精确的定位
2013-12-15 02:57:02
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该文档为基于FPGA的数字时钟的设计讲解文档，
在QuartusⅡ开发环境下，用Verilog HDL硬件描述语言设计了一个可以在FPGA芯片上实现的数字
时钟．通过将设计代码下载到
2022-09-08 03:00:02
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在Quartus6.1和niosII6.1环境下编译通过，并且下载到板子上运行成功
2017-08-18 10:41:01
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SOPC技术是美国Altrea公司于2000年最早提出的，并同时推出了相应的开发软件Quartus II。
2023-12-23 12:20:01
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在QuartusⅡ7.2软件平台上采用基于FPGA的VHDL语言实现了有效的编码过程。结果表明：此方案在保证高效可靠传输的同时降低了实现的复杂度。
2024-09-12 16:00:02
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